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標題: 關於用MOS做的電容 [打印本頁]

作者: tommy01    時間: 2010-4-12 09:25 AM
標題: 關於用MOS做的電容
會先把S,D端相連,要形成電容必須有上下極版及中間介質, |0 @- W4 \2 \. f
若是NMOS電容:上極版是G端,中間介質是薄氧化層,下極版是P-sub嗎?
作者: motofatfat    時間: 2010-4-12 11:00 AM
下極版是P-sub嗎?. H7 H/ [  I" U7 h
應該不是 下極版應該是 薄氧化層+ o. h* h/ P  n3 j: U2 f2 K2 N
S, D 相連就變同一塊ㄌ
作者: tommy01    時間: 2010-4-12 11:44 AM
我剛有再去翻書看一下' M& O; b* _* ^/ m$ |: a5 ~
下極版好像是通道# I% \$ k* Z! W  S4 u
而薄氧化層是型成電容之間的介質
- J+ A; E& D" d& r表示要做MOS電容,上極版電壓要比S,D電壓高出Vth
2 {2 x3 X7 Y' \才能做出嗎???
作者: bernie820    時間: 2010-4-12 06:28 PM
不是p_sub喔!!
2 y1 n) S; X" T# d8 m+ b5 Y
( k" }' K; t! V1 B3 U. X0 m是通道形成後和上面的絕緣處形成一空間. _( [& \# e3 ~  }
& {, K% G3 g6 ]3 R' x9 n# @: P
就如同電容一樣!!
作者: tommy01    時間: 2010-4-12 08:41 PM
再請問一下
# X3 l; N/ F$ w9 y0 [5 O" T; j! T若是跟通道形成的,不是會有三種情形
& T, H) ]1 W+ M% F* ~1,通道未型成時
/ y. v, N6 E4 P: o2 u" _2,三極管區8 Q4 Z2 t5 {' K( w. d6 m1 P
3,飽和區
1 m. a3 ]& K. R; |/ u7 Y( X- b, I3 y8 `此三種的L好像都不一樣?
作者: yuany    時間: 2010-4-13 09:33 AM
过来看看~~~学习一下
作者: dizzy    時間: 2010-4-15 12:05 PM
如果接在G上面的訊號電壓大于Vth時,NMOS工作在飽和區
- r6 w3 S/ h* {  ?0 K7 b1 _. i這個時候下極板應該是gate下方的反型層吧
作者: L_ju    時間: 2010-4-15 09:07 PM
[attach]9341[/attach]
9 Z! i- c4 Z8 u4 P, Y; Kmos电容显出较强的电压控制特性,图显示的是nmos作为电容世道容值曲线图,当gate相对于衬底为负电压的时候,多子被吸引到上面(氧化层下)形成积累层,在积累区工作状态下的nmos电容容值只有氧化层电介质决定,,(注:其实就是由两极板间的电解质面积和电学性质决定的,这就是本征电容C本)
2 d" b. O7 J; }( k3 ?当gate相对于衬底正电压时,多子被排斥开表面,耗尽层形成了,随着电压差的加大,耗尽区越宽,容值也降低,一直到电压差等于阈值电压时,少子会被吸引到表面形成反型层,随着电压差的进一步增大,仅仅增加的是少子的浓度,而不会增加耗尽层的宽度,容值等于C本的20%左右。
) m7 ^1 `: d; W/ R/ Q/ V! b& N以上分析仅仅是s和d diffusion 不存在或者没被连接到衬底的情况,如果s和d 存在并且连到衬底,那么这个mos电容就有点复杂了,一旦强反型形成,一个导电通道short了s和d,这个通道变成了电容的下极板,容值又升到和C本 一样大了。, ^7 }- X, m; C3 j6 r
Mos电容一般应该设计让他工作在远离阈值电压中心以外,如果device工作在积累区,没必要接s和d diffusion,如果device工作在反型区,想达到满电容就必须把它们和衬底连一起,
作者: tommy01    時間: 2010-4-15 10:41 PM
謝謝這位大大的解說,還有付圖片,讓我更了解了
作者: iamif520    時間: 2010-4-16 02:14 PM
Good job~ Nice talking~ thank you~
作者: L_ju    時間: 2010-4-16 09:03 PM
所以做mos电容应该一端接poly,另一端接source-drain-pickup这3点就保险了,这样就得到如图中所示的"v"型曲线,如不接source-drain,就是如图所示的"Z"型曲线.
作者: dysyase    時間: 2010-4-18 11:44 PM
但是~這種電容~不會很吃製程嗎~~~如果製程飄移的話~不就趴了~~
5 I) g2 l; {! W) l- m8 ^7 T3 b所以~需要準確的電容時~~還是可以用嗎~~
作者: pph_cq    時間: 2010-5-5 10:05 AM
如果一端接poly,另一端接source-drain(没有和pickup接在一起),会是什么情况,会有满电容吗?
作者: shmiyi    時間: 2010-5-7 10:47 PM
用GATE和DIFF之間的通道作電容特性用
作者: chriskomh    時間: 2010-5-10 11:44 PM
這種用N/PMOS做的電容好像誤差比較大$ g9 C) E9 Q6 m  {; J6 A% H/ J
小弟在這篇也了解不少事情XD
作者: semico_ljj    時間: 2010-5-11 08:56 AM
下极板是反型层或者是积累层!
作者: semico_ljj    時間: 2010-5-11 08:57 AM
也就是说MOS Cap 不是工作在耗尽区就是积累区!
作者: ma530214    時間: 2019-1-25 09:01 AM
過來看看~~~學習一下undefined

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作者: 111222ak    時間: 2019-2-11 05:36 PM
過來看看~~~學習一下
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