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標題: 請問電壓比較器 [打印本頁]
作者: bernie820    時間: 2011-1-3 09:14 AM
標題: 請問電壓比較器
請問有關電壓比較器的問題/ q0 F9 p# t* A. S6 Y% D
  \" y5 }2 q; s0 c4 S
是否兩輸入端皆可為非固定的電壓) Y1 w! Z# Y* U5 M- e# g+ l

* J/ Y5 {8 @( P1 \' \看很多設計都是一端接dc的vref做判斷
2 t% S0 V5 h& P4 d0 [: L0 P7 z$ [7 l) a% a
但現在我的輸入端為兩個都會改變的電壓~
6 n  N: Y* I# X9 I3 h/ t
' i* n, r$ X- F/ o8 \那請問這樣要怎麼設計?~謝謝~
0 P; P  W  X$ P: {( Q
1 Y" n$ Y6 ]9 x6 l. x& Y* V( [我要拿這兩個電壓做比較~
2 E9 C0 n$ \# J' h) |/ B一個電壓是由輸入端輸入，另一個是由輸出端拉回來和輸入端做比較
; H% C% x' m+ q7 i; S9 [所以我的兩輸入判斷電壓是不固定的，% _: _+ v8 N. E  Z) q
只要輸出>輸入結果會為high* j' L$ e' d3 N3 B* k* Q. N
然而輸出<輸入結果為會low
, N% K8 O. w4 V9 b2 d; g) Q不知道這樣行不行設計?4 L* _# @6 g4 ?5 F& k
3 @1 n, F& }. U: m
但考慮到另一個問題，那兩個相等的時後是否也可為low- }1 X8 p2 j$ `( [1 \
但是兩個要相等好像也很困難吼!
作者: jackrabbit    時間: 2011-1-6 05:02 PM
您的作法很矛盾....
% W3 m3 I8 G/ I) S  N* i1 l7 P比較器是把OP用在開迴路狀態
" @% C( p+ p" L) i4 U. K8 L$ w你直接把兩個想比較的電壓輸入OP的兩個input, output端自然會有H/L
9 a) z) E3 y7 V+ [# e- x至於誰比誰大是發High, 取決於你選的input 極性
. E: e4 b$ I* {; Q4 c7 ]' n而且通常會有一個遲滯範圍, 來避免false trigger~+ L8 i8 J) f3 Z6 \5 ?

5 Z9 f& N. w( q; L% u3 `% T" X; j) ^把輸出端拉回到input是迴授系統(feedback)
% f) w* }/ E2 M7 W6 `  V負迴授是一般所謂的OP, 最常用在voltage regulation# e* U1 f: t# t1 G) R7 N9 v
你看到的input 一端給vref 另一端拉output回來就是!!
6 S4 E& P& t1 V8 c( I9 B正迴授要不是output拉到always high or always low, 不然就有可能起振~5 s6 ]2 V+ @2 k- j

) P1 y) U1 r' X  \如果看不懂我在說什麼, 可能要先翻翻教科書~~
  z+ `6 t' O, q. N% ~Baker那本有一張專門在講comparator design, 可以參考一下!!
作者: bernie820    時間: 2011-1-13 12:36 AM
您的作法很矛盾....' f* G& n) E2 z( l, e! Q/ t
比較器是把OP用在開迴路狀態
# o: m, ?; x0 l1 ]. R% d/ i你直接把兩個想比較的電壓輸入OP的兩個input, output端自 ...9 F- P$ B( P. o9 K) r
jackrabbit 發表於 2011-1-6 05:02 PM

, T3 p. i' _  l. B- N/ x7 Y0 n/ }# [+ F2 U) i  f

# y7 {7 f2 a( R2 t    嗯!您誤會我意思了~抱歉是我說的不清楚!
/ O9 l$ {$ c5 u8 b我輸出拉回來的不是op那一電路拉回來比較(我知道那是隨偶器)
2 G  P( c/ U2 ?, L. B- B% m而是最後一級輸出端會拉回來和比較器輸入電壓做比較
# A5 w/ k8 `8 w1 k2 b
% H: w+ k: B  l, B但是我現在有一大問題是我想要在兩電壓(類比)相等時(或已經很接近時): P0 u, k. L) j# N( _
可以有一輸出訊號(不是最後端電路喔)為 0 or vdd的電路設計
作者: sky987    時間: 2011-2-23 10:33 AM
那不就是一般的 latch-type comparator : G) A: t4 A8 M% ]
通常會藉由cross-coupled 的架構來把電壓分開至VDD與GND" f; @) i2 s8 ]  G& Q7 W
. w. s1 [" P9 X2 v1 p: r- @
要記得加上reset電路來把讓它重新啟動  不然電壓會一直鎖死在那邊
( s& J8 l5 I; l: U2 d6 ~7 l. ]6 D7 I( y. p
自己搜尋看看囉
作者: yeutay    時間: 2011-3-7 07:24 PM
-----是最後一級輸出端會拉回來和比較器輸入電壓做比較  -----
$ s  ^" Z$ e, @1:如果是,拉回來和比較器+IN輸入電壓做比較  則形成史密特觸發,如果-IN電壓無法大於+IN電壓,則被鎖死(同樓上說法)
5 I0 ]! h, F+ i/ N2:如果是,拉回來和比較器-IN輸入電壓做比較  則形成正相放大器。若最後一級輸出端會經轉換成其它信號(如峰值保持)就有比較器作用。



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