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標題: Cortex-M0/M3/M4 Source Codes [打印本頁]
作者: sinoicboy    時間: 2014-3-18 03:15 PM
標題: Cortex-M0/M3/M4 Source Codes
Cortex-M0/M3/M4 Source Codes9 W+ S0 V& T. q% o

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6 {; d3 p, m% M$ E) B% s+ p# n* L: \- f0 p  a% k' _+ S$ G% Y: o" S3 s
├─AT420-DA-03001-r2p0-00rel0
7 I; o, J% d% t3 k. \1 I# ?│  └─docs2 x, u, h- c" q" ]
│          DDI0337G_cortex_m3_r2p0_trm.pdf0 `( D2 r( j; v3 l3 _
│         
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! B9 W4 l7 F  {' W: x; v│  └─docs: k% o6 }: v: R2 l
│          DII0194A_cortex_m3_r2p0_csg.pdf% t# @7 j: w( n
│         
% `- I/ {# x9 T0 L8 a! o7 K├─AT420-DC-13001-r2p0-00rel0+ u6 |: P, w0 T
│  └─docs8 y- R7 _4 o( P! J7 \0 ^5 `

5 s7 f8 M$ _3 T$ {9 }│  │  │          CM3CodeMux.v
; E* ~% g7 L' f$ Z0 c│  │  │          CM3flashmux.v& k: P$ g( j8 ~: f- N5 i
│  │  │          CM3ROMTable.v
' m, n& i' e7 x│  │  │          CortexM3Integration.v; y! Q- `: n$ j" ~& q' y0 H- e
│  │  │          - o3 s; U3 S" v4 q2 l5 n
│  │  ├─dapswjdp
4 s, e' G8 B6 f( D+ p│  │  │  │  README_DAPSWJDP
, ?0 R3 F% s2 X( {3 b│  │  │  │  8 ]5 H# o6 b* i+ ]- W4 ?; g) I
│  │  │  └─verilog! a3 J% J& T+ E9 k
│  │  │          DAPDpApbDefs.v1 b5 d+ |5 U. ]% C; z1 F) Q
│  │  │          DAPDpApbIfClamp.v& J+ o4 j1 `0 o. h  ]  ?, L- A
│  │  │          DAPDpApbSync.v1 m7 o% e6 R* l8 c* i7 Q) S8 g
│  │  │          DAPDpClamp0.v) t* H( \  w0 o4 j
│  │  │          DAPDpEnSync.v& e9 V. x8 g% g% @& s# A
│  │  │          DAPDpIMux.v# p+ m9 R4 v1 G4 s* t4 o' I
│  │  │          DAPDpSync.v: }) ]2 ]4 i0 w. A
│  │  │          DAPJtagDpDefs.v8 B6 t8 a; z  Y& _$ X: Z
│  │  │          DAPJtagDpProtocol.v  |3 e* \& {6 G1 H( |
│  │  │          DAPSwDpApbIf.v- d; ?# x& k+ @" v/ ?( r; y; e
│  │  │          DAPSwDpDefs.v0 U' z: U0 T3 n% d2 v3 M
│  │  │          DAPSwDpProtocol.v
6 a/ ?! _. q% R$ ^" o% ^│  │  │          DAPSwDpSync.v
3 g( f# z1 H8 j; u/ X0 S│  │  │          DAPSWJDP.v
- f" N$ s  z* x* e│  │  │          DAPSwjDpDefs.v
+ m/ B" j3 Q) A; E( t│  │  │          DAPSwjWatcher.v+ q. Q6 A" f4 X
│  │  │          1 o+ `6 a% {8 \+ ^. N/ V# h  B
│  │  ├─models) V& A9 r* O3 H1 Q0 ?% C/ r
│  │  │  └─cells
, I. [: }7 K8 {  T. m$ j7 g│  │  │          CM3ClkGate.v
' E5 a+ d) U4 ~3 y: H( g│  │  │          CM3EtmClkGate.v2 T% r- @- R* {/ j
│  │  │          CM3Sync.v& N( z: ?; \7 v/ S
│  │  │          4 s# R/ w, U6 i) M# q
│  │  └─tbench* w  k* e" P, L' y; T" _7 `
│  │      └─verilog
8 O7 W* w- \6 K) t6 X7 l6 Q│  │              AhbToApb.v
5 K  `# D' B8 P) ?, x0 k; }│  │              AtbLogger.v
" k4 Y7 c7 d8 ^, Q0 O│  │              BusMatrix.v
6 A- E) @! z1 N( |│  │              ClkReset.v
: Z5 V! |) j* b2 L$ I) y│  │              CM3BusComparator.v
+ N9 @4 Y: R0 ~% i$ g9 i" c+ p4 ]$ d# S7 W

; B; J% C7 H5 W│      │  │  exclude_list.sc_waitstate
2 U% S# ]4 ^  ~( R4 e& ]' p
) K! g$ Y( L8 f% s# y  t             │  └─fe_tsmc090g_sc-adv_v10_2007q4v26 l/ K0 W2 a+ j! ~4 h0 j9 d/ G
             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB. W) \( k8 r: f. N9 O! L
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB7 e4 z3 Y; L' c. x! P. E2 n  M
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
$ q& g4 K1 Q3 H+ ]             │      │  + ]+ ^6 M8 |' C, Y" e7 \6 S
             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl! G+ m! p8 j) a1 K" U/ ?
             │              cells_1.geo
6 B  i( [( u! L* W             │              cells_1.pwr
% i- R. T; C! a8 b0 O6 i             │              index.cli5 v& Z# ?' T& J7 A- y& W7 i
             │              README.TXT# {* K# W# q7 e( F, v5 |# n( ]1 C
             │              rulesets
8 g3 u- [, ?8 y: @( T. M             │              VERSION.TXT
( |. R0 l1 V! I" d% `5 \             │              vias_1.geo
# W* Q3 o6 l* x             │              
! ^5 b- k" I( l/ A' Z             └─tsmc: n8 K$ g: u# x3 p& ?) r
                 └─t-n90-lo-sp-002-f1_1_6a_20060914! A8 {3 B0 A4 U/ C' f; c
                     └─6X2Z' f4 u( S! G, F& I7 O- g( G7 t
                             corner.defs. k! P; Q4 v, @1 ~, ^6 @  ]

2 ~$ M: e( P; m( X├─integration_kit
* E6 p4 B# a2 x& [# A7 x│  ├─logical
/ y$ ~2 }1 g9 P  @│  │  ├─cm0ikmcu8 P: i# `6 R4 _# a2 K- X
│  │  │  └─verilog
2 \1 C& m( Z0 I6 i, k│  │  └─tbench6 f' t( e* v$ l
│  │      └─verilog
9 c8 q+ m3 ?& e: G, I- N/ x│  └─validation& b# ]' Y; H( d, w8 m( [
│      ├─glogs. I- B$ m% ~! ]1 c# p. y
│      ├─logs
, l0 Y' q5 `9 H% \0 m* U8 v4 s" n│      ├─mdk: q5 P, K' x; l5 b8 ~3 }" K% W
│      ├─srpg
% [; C3 U0 \: e│      ├─tests
) D9 f" L0 d! V│      │  └─CMSIS, D& N# q. L* P. A$ L+ `, p
│      │      └─Core
) y$ g  w4 k2 X3 z. u3 K│      │          ├─CM0& X7 Y* N, j  v7 z" }9 w1 s4 i
│      │          └─Documentation6 O: f0 ^9 ]* |4 @4 u- r; j' B
│      └─vectors  l+ n6 h0 f% e+ A) M
├─ipxact8 j+ s' C: P* F" E+ p, w, m
│  ├─busdefs1 f; d' a$ J8 B3 r# g
│  │  ├─amba.com6 z3 P0 x( T* y( {# b8 J0 n
│  │  │  └─AMBA3% n4 d. g2 i; @) u
│  │  └─arm.com4 A' L6 m; y" `: ?5 `: w! ~) m
│  │      ├─CoreSight
$ f, l7 h7 ?. T& r, L│  │      ├─Cortex-M0/ J4 X3 M  n% |: X5 X
│  │      └─CortexMCores
# K, U, h" D/ D$ @( v│  ├─channels
. Y: c' T1 w3 ?: T5 B& S│  │  └─arm.com
1 O9 v( p+ D3 l; a% d. _# v, p│  │      └─Cortex-M0
, r0 Q- Q3 m$ d# ~# C2 Y( J- I, f│  │          └─rtl6 E% U$ s  n9 j+ {
│  └─components
; Q& Y- v! L" E$ e, y1 P│      └─arm.com
' X) s6 W2 |/ h9 v& P  w1 f│          └─Cortex-M0



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