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【深圳】招聘 数字逻辑设计经理
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作者:
nuoan
時間:
2014-7-20 09:26 PM
標題:
【深圳】招聘 数字逻辑设计经理
参见中国人才热线：cjol
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浙江博耀微电子科技有限公司是专业研发超高速无线传输芯片的高新技术企业。
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1.数字逻辑设计经理
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背景要求：
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1、大学本科微电子专业，八年以上相关工作经验，或者硕士微电子专业，六年以上相关工作经验，或者微电子专业博士毕业,三年以上工作经验，经历过从概念到芯片产品量产的全过程
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2、有5年以上数字电路设计经验，需熟悉WiFi射频处理算法
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3、有多颗IC的量产经验，做过2.4G WiFi芯片者优先
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4、熟练使用数字IC设计的EDA工具，包括仿真、综合、时序分析等
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5、英语CET-4，具有良好的英语读写能力
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6、具有较强的逻辑思维能力、良好的沟通能力和一定的团队协调能力
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7、认真踏实，有责任心，工作积极主动
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职责范围：
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1、根据算法或设计规范编写RTL代码并撰写设计文档
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2、负责指导团队内其他数字设计工程师的设计和验证
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3、芯片数字部分整体的综合，时序分析和优化逻辑电路
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4、负责指导测试工程师完成芯片的debug/validation/testing
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5、负责产品定义，和市场销售部门紧密配合制定三年至五年期产品路线图，
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6、负责数字逻辑模块设计和验证的审核制度，对最终产品成败负责
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7、开发数字系统架构，参考模型，测试计划，测试环境等一整套工作流程
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8、具有较强的电路设计推导分析能力，扎实的正向芯片设计能力，以及芯片样本的分析测试能力。
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9、有MTK, BroadCom, RealTek, Atheros等芯片设计公司相关的工作经验的最好，优先考虑。
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10、有至少2款RF芯片的实际流片及测试经历。
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技能要求：
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1、熟悉数字逻辑设计的前端和后端设计方法，涉及工具，以及设计流程
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2、掌握数字逻辑前端设计，重点要求RTL编码（Verilog, SystemVerilog, C, C++, SystemC），验证，最好有数字综合和静态时序分析的经验
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3、熟练利用UVM, OVM, VMM, 或者eRM等方法创建有约束条件下的数字逻辑验证环境
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4、熟练运用检查工具建立和分析function coverage, assertion coverage, 以及code coverage
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5、掌握FPGA算法实施，和验证的流程，工具和调试
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6、掌握从制定性能指标到流片测试的全套工程设计流程，有相关的项目流片经验
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7、掌握必需的设计工具，例如Cadence工具(SoC Encounter RTL compiler), 或者 Synopsys工具 (Design Compiler, and Primetime)
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8、具有低功耗设计的实际经验
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9、可以进行脚本编写，Perl, UNIX Shell, Python等等
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10、熟练英语阅读、听说和文档写作技能
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11、具有很强的创新理念，解决问题的能力，和与中外同事有良好的团队合作精神
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