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標題:
�定周期,可变的DUTY,如何实现?
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作者:
cicer
時間:
2008-4-28 10:38 PM
標題:
�定周期,可变的DUTY,如何实现?
附图是一个OSC电路,可知T=C*(VH-VL)/I1+C*(VH-VL)/I2;
9 R5 v& W1 W' u/ ~' ^! Z
+ V# P+ c9 G- o1 R. M
可以通过调整C,VH/VL,I调整频率,如果要获得�定周期,可变的DUTY,如何实现呢?
0 ?( t' }$ `4 h0 g0 G/ _
8 y, \) v% h* v& ^; [. H
请各位大大指教,谢谢!
% \( V& u0 V9 ]; x
/ O# {2 E( |2 X. K
[attach]3767[/attach]
作者:
cicer
時間:
2008-5-3 11:04 AM
各位大大,有没有好的方法,请指教,谢谢!
作者:
finster
時間:
2008-5-5 11:16 PM
我以前有試過一種在vco後面加duty cycle correction電路,那是為了校正vco的duty cycle而衍化出來的電路
+ T! ?: O6 g3 [4 ]- q
那是一種利用負回授的方式來實現的電路
; ~2 Q# X6 o* p! V
不過,這種電路可能不太適合你的需求
5 {. A0 B1 R. a5 Z* E' F
, G# n+ X8 d# a. w+ L5 L
而因為你需要固定週期內去變duty cycle的話
6 s+ N3 P* c$ A% _, I
那惟有在sr-latch後面再加一些數位電路應可達到改變duty cycle的功能
" u6 ?9 B0 c+ y+ u [4 d j+ n; g
基本上我想到的方式是利用delay cell再加一些數位邏輯電路應可實現
& X3 |, s5 [- I+ E+ V" U
若想加長duty cycle,那就用OR Gate + delay cell電路(加長)應可達到需求
$ V- Q0 D' _3 _, I$ i
若想縮短duty cycle,那就用AND Gate + delay cell電路(縮短)應可達到需求
7 T; ^$ l8 K' J1 h& ?; |0 V
如此一來,便可利用數位控制的方式,藉由控制delay cell timing即可作出想要的duty cycle
作者:
monkeybad
時間:
2008-5-6 03:09 PM
題外話
9 P# @) z/ Z' V/ j5 V( l8 {
VCO duty cycle corrector 是很好玩的電路
* z. _, Q9 Q$ t7 c
我之前有發明一個 拼湊一些paper的概念所組成的電路 也是用負回授的方法來產生50/50的clock
& W& F a" o9 x6 i
finster大能分享一下如何實現的嗎 也許我可以觀摩一下
: p- z. e5 _& o1 n7 t0 w
我另外再開個討論版好了
作者:
mbission
時間:
2008-5-6 06:17 PM
標題:
回復 1# 的帖子
也許可拿你電路產生的定頻clock去充放電另外一個可變的CAP或充放電固定的CAP
( ^2 E; x$ u/ F
,改變比較器的轉態電壓~~~試試吧
作者:
finster
時間:
2008-5-7 03:53 PM
這是我想到的方法
$ o- X' E! v8 V" V9 n
利用delay cell和簡單的數位電路應該就可以改變duty cycle
7 M* A l7 S0 p+ L7 v7 N- W( h
因為提問者的前提是clock不能被改變,所以,就只能從輸出的clock著手動手腳,如果改變本身charge/discharge current,或者Vh/Vl電壓,或者電容C值均會改變原來的振盪頻率
. d" R2 M/ ~6 H+ a- C
不過,這種方法有些缺點,因為delay cell的精準度很難控制,所以,未必能夠很精準的控制duty cycle,當然,如果要很精準的控制delay time,相對的電路就要設計的複雜些
' N4 S+ P' c/ ]3 Q4 U4 g
再者,如果clock愈慢,表示其delay cell的delay time要設計的愈寛,那用反相器加電容的delay cell未必適合
作者:
mbission
時間:
2008-5-8 11:29 AM
用定頻的clock去控制充+放電時間,所產生出來的clock應該是同樣頻率,
& }9 B- c& e* M1 m0 y$ C; b9 }% ?
改變電容值或轉態電壓,便可以控制duty,用delay cell做,很難cover較寬
! I4 f3 B. t3 G5 P3 u
的頻率,並非上策
作者:
cicer
時間:
2008-5-8 09:13 PM
finster大大是利用BBM(break before make)的方法去做的,谢谢!
( y0 V" D9 W' Z& P! f; r* s
" _6 U: n; T& \+ V
如果DUTY不连续变化,那么调整CAP可以改变DUTY(固定周期)
; y% z7 J3 P1 a/ B" w' g0 I5 X( Z
T=C1*(VH-VL)/I+C2*(VH-VL)/I,,充放电用不同的电容大小,只要保证C1+C2不变,就可以保证频率不变了(理论上的),
! }; G* A4 b! w
DUTY连续的变化,上述方法就不好实现了................
' h4 O, g/ w$ C- R6 p! o; u
) w5 L: P; V+ O5 N
mbission大大能再具体的讲一下吗 多谢!
作者:
mbission
時間:
2008-5-9 09:36 AM
用你上面的電路產生出來的定頻的clock,去控制另外一組RC充放電電路
) m6 |* N: N% u: g) O6 ], Q2 ]' _' {
,改變充放電電流比例或切換轉態電壓,應該可以得到你要的波形~~~
作者:
kevin
時間:
2008-5-10 11:07 PM
其實上面這個OSC RC 充放電線路,就是555 timer IC的線路主要設計,只不過少了voltage control input(可用來調duty cycle)
& N+ L9 U' ~! a2 ] w* l5 E; G1 d
稍微改了一下,看可不可以.(VR 用來調duty cycle)
) C7 P) J9 Y; u- Z0 _& w. B3 w+ r
5 `; d Y, D$ r9 {4 w
[attach]3952[/attach]
作者:
cicer
時間:
2008-5-11 04:03 PM
谢谢kevin!
6 [/ `7 O, k/ n# `% i( j7 [6 K6 `8 K
5 o9 G3 ?( c' W1 e+ |
但是如果VR变化了,那么频率也会一起变化的
作者:
kevin
時間:
2008-5-12 10:16 AM
我是假設R4 跟VR很大,所流過的current很小,則VH-VL會保持不變(只跟R2有關),則頻率應可固定.
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