Chip123 科技應用創新平台
標題:
Duty Cycle Corrector circuit
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作者:
monkeybad
時間:
2008-5-7 08:47 PM
標題:
Duty Cycle Corrector circuit
之前在做PLL時, 為了能達到50% duty cycle的clock, 我把VCO頻率震兩倍在除頻下來
5 M( g9 h' x' L4 t7 C: U
就可以達到50% duty cycle, 但是總覺得這樣做好像很浪費power
9 Y* `4 `8 |2 W( J _
所以就參考了一些有關duty cycle corrector的paper, 電路自己再稍微改良一下, 相關電路如下
& F. ?4 W( x- a; [ p
給大家參考看看
$ t/ D6 r1 T* v6 U" C
; y( q2 Y. k6 l, T0 Q* z6 t! d9 t
電路並不算複雜, 但是仍可達到調整的功能
( r+ K/ L. D! ~" F; H
主要運作原理是先把CKIN除以2得到CKIN/2
3 S$ g5 W" V7 s( w$ B* y
再用VCDL產生一個delay的CKIN/2, 然後跟CKIN/2做一些邏輯運算得到CKOUT
3 ]; I4 i5 `9 q6 N
Inverter掛個電容是一個duty cycle to voltage電路
# _$ K; W- L. x. o/ _
用兩個反向的duty cycle to voltage電路產生一對差動電壓接到OP產生Vctrl
; f. C" N$ t+ u9 d! `; R
OP用簡單的一階放大器就可以了, 外面再掛個電容再濾波一下使Vctrl ripple更小一點
+ l0 r2 I/ ^7 k( g
然後Vctrl再接回去VCDL的控制電壓上
1 e; j* _; e! v% n/ r- F7 H
VCDL: Voltage Controlled Delay Cell
. M& [+ h+ p0 P2 t n- o
+ t a( n$ u+ W1 ?2 w
主要參考這篇paper:
6 ^4 i" M& q; L- N, f/ _; e8 ^
S.Karthikeyan, "Clock duty cycle adjuster circuit for switched capacitor circuits"
; P7 `% S& F/ J) c8 a$ W5 _3 N
( }4 z9 P6 l8 z3 s# S+ a. |
非常非常省電 我只用了約240uW左右(CKIN約500MHz)
0 f& |1 \1 m8 R" g9 T" o) h$ j/ j( K+ E
( u, q, u! y& I
[
本帖最後由 monkeybad 於 2008-5-7 08:50 PM 編輯
]
作者:
shaq
時間:
2008-5-7 10:53 PM
Oh! man!
$ u1 h# q/ J& g- k9 D& F
+ y- L# R+ }) g$ Q$ V
That's what I'm looking for!!!!!
% a3 Z% b) _- d
Thanks so much!!!!
作者:
kevin
時間:
2008-5-8 01:07 PM
圖中CKIN除以2得到CKIN/2 不是已經是50% duty cycle了嗎?
作者:
kevin
時間:
2008-5-8 03:37 PM
sorry,你目的是要得到CKIN的frequency,不是CKIN/2,
* Q+ P7 ` d" O
如果是這樣,comparator一端以fixed reference voltage來作比較,會較有彈性,duty cycle可以由外來改變,且duty cycle比較準.
作者:
cicer
時間:
2008-5-8 08:53 PM
very good,thanks!!!!!!!!!!!!!!!!!
/ W: b% k' m2 G& e
1 B0 t. `+ }4 M' h! l8 s
t/ d! `8 e; f$ j/ G. Z# i1 I
可以说是VCO和PWM思想的结合
作者:
hitxiaojun
時間:
2008-6-3 06:36 PM
very good!如同甘露降临!我不断学习,不断前进!thanks!
作者:
staplerli
時間:
2008-7-11 04:32 PM
Very Good!!!!!!!!!!!!!!!!!!!!!!!!!!!
作者:
mixsignal
時間:
2008-10-7 11:04 AM
真的很不错啊，不过觉得有点复杂。有没有更简单的办法呢？？？？？？
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