Chip123 科技應用創新平台
標題:
如何透過DC找出跨不同Clock Domain的訊號
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作者:
nemo
時間:
2007-2-23 10:44 AM
標題:
如何透過DC找出跨不同Clock Domain的訊號
Dear Sir,
4 I! l2 _, _/ M- l6 s- w% J* g) A
: m, N: g- I4 C& u, h. k3 P* |
為了防止設計中的失誤發生，我必須確保每個跨不同的Clock Domain的訊號是否有經過特別
9 I. x z) W" }6 r
處理，或者訊號本身就是一個False Path，旦先決條件就是我必須先將所有這類型的訊號一一
7 s& d" F8 J! W
找出確認。
& A. S3 R9 A6 D+ t4 @8 S/ r
有誰知道如何透過DC找出相關的訊號，或者你們知道利用其他EDA工具幫忙尋找，請說明如何
! }% ^7 z* s5 ~/ X. A
使用？
% u7 b0 A& f$ f! c2 I. M2 Y
謝謝！
作者:
masonchung
時間:
2007-2-23 12:12 PM
您可試試 Mentor Graphics 0-In® Clock-Domain Crossing (CDC)
! ^* g! C8 ?1 T/ M
利用其中一項功能：Automatically identifies all clock groups, derived and gated clocks in the design
/ h: L( ]2 P8 `2 q3 S' @
http://www.mentor.com/products/fv/abv/0-in-cdc/
5 _4 _8 ~+ L8 o8 Y
& t, G7 s Q5 t: u: h( A, `
[
本帖最後由 masonchung 於 2007-5-16 10:50 AM 編輯
]
作者:
hsd123
時間:
2007-5-21 02:37 PM
在 SpringSoft 的 verdi/debussy 中也有 clock domain 的分析,
& C$ {- j) e2 h
可讀入 sdc file 來設定 clock,
+ m0 k' Q% z9 g1 L, Y9 A1 r
可瞭解 clock domain 也可 check synchronizer...
作者:
masonchung
時間:
2007-5-30 11:53 PM
hsd123 大大
. f+ k4 ]; z2 Q; ^ P
要讀入sdc file
# O7 w! Q/ N; }& n
這個是合成過的gate-level 設計才能用的分析方式嗎
# }# `3 x3 O' L0 H: m3 I
不過這是最新的 verdi 才有的功能嘛？
& n3 Y% V4 r, M' s6 L
. T. b+ C% N1 T: k0 @4 L: @- M
[
本帖最後由 masonchung 於 2007-5-31 09:50 PM 編輯
]
作者:
Huay
時間:
2007-5-31 12:59 PM
Cadence 的 Conformal CDC 提供 clock domain crossing check 的功能.
8 e" ?/ T5 |6 D( a K
可以在 RTL level 便讀入 SDC file.
# B5 Y* l- k7 z" t
也可以從 gate level 來做驗證
1 d, T4 B) y/ f
檢驗 clock domain 是否完備.
6 m/ D' p+ w/ Q5 ^1 D; q1 ^
是否有遺漏的 clock 宣告或不適當的 clock 宣告.
3 S$ D) D. g9 i u# H5 V$ r# g, J
除了使用者自訂的 synchronization rule, 亦可使用 Conformal CDC 內建的 synchronization rule.
0 j A" y8 y$ C/ l" ^' Q
幫助使用者在剛開始建構環境的階段快速的完成檢驗.
- d$ @$ V* j5 c5 a( H: K
Conformal CDC 也提供 convergence check.
作者:
hsd123
時間:
2007-6-6 04:11 PM
標題:
回復 #4 masonchung 的帖子
RTL & Gate-level 都可以,
( N# Q* g( t) _! I/ U! Q- v
不一定要 sdc file(=>方便設定), 可以手動設定或讓 tool 自動 extract,
# @) r( }. s w2 m. {% {: r
新版的 debussy 與 verdi 都有 clock 方面的分析,
9 J0 V4 |+ v2 {- L& ?
其實跟 Huay 提的 Cadence Conformal CDC 功能類似.
作者:
jerryyao
時間:
2008-1-29 02:34 PM
標題:
回復 6# 的帖子
請問debussy是從哪版本開示提供clock 方面的分析的分析，54V6有嗎
作者:
chienw
時間:
2009-4-10 03:06 PM
看起来现在大部分人都靠EDA工具解决问题，我们以前都是通过使用一个专门的sync cell来做domain crossing。每个cell instance会用一个特定的命名方式(例如sync1, sync2, etc)。这样一下就能把它们都找出来.
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