8/9(二)半導體產業盛會EDA360 Cadence Tech on Tour--迎接40/28nm的全新挑戰!

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半導體產業盛會EDA360 Cadence Tech on Tour擴大舉辦
; e5 F3 h/ J, S; P& J( Z5 E2 C, X您準備好接受40/28nm的全新挑戰了嗎?
) o. s$ I- t# ]0 a3 @) Q半導體菁英齊聚 激盪更完整的電子設計技術解決方案
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. t2 ?  ~: p( K) t* |8 ^( B& Z* g2011年 8 月 2 日; 台灣新竹 – 全球電子設計創新領導廠商Cadence益華電腦將於8月9日(星期二) 假新竹國賓大飯店舉辦一年一度的EDA 360 Cadence Tech on Tour。Cadence業務暨營運副總裁黃小立為此特別來台，與您分享電子系統設計領域所帶來的轉變，以及因應這項轉變的EDA360半導體大趨勢。除此之外，包括Andes (晶心科技)、eMemory (力旺電子)、Faraday (智原科技)、GlobalUnchip (創意電子)、Graser (映陽科技)、Socle (虹晶科技)、UMC (聯電)等多家半導體產業鏈合作夥伴也將與會分享最新的研發技術和產品。

去年Cadence益華電腦宣布為電子設計產業提出設計的未來藍圖 - EDA360，提供一個從設計到系統整合、應用開發與系統驗證的完整平台。今年的EDA 360 Cadence Tech on Tour我們將呈現EDA360願景特別針對40/28nm所達成的產品解決方案，以及討論實際案例的技術講座，並搭配會場上產品展位的介紹與實機操作，與您分享最新技術與方法，協助更多業界精英，在越來越嚴峻的開發環境下，克服設計挑戰，具備更高競爭力與獲利力。
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6 X  S- _8 l9 C0 QEDA 360 Cadence Tech on Tour讓電子產業設計菁英們有面對面接觸的機會，多年來已經成功讓設計開發工程師和各業界專家共同激盪電子設計產業新的解決方案。今年EDA 360 Cadence Tech on Tour 活動內容涵蓋廣泛，議題包括從ESL、數位類比IC設計到PCB的完整設計解決方案。歡迎半導體產業菁英踴躍報名參加EDA 360 Cadence Tech on Tour，讓您更進一步了解Cadence益華電腦新的解決方法和產品特性，並運用 Cadence益華電腦技術進行更多先進的創新與研發。

. |8 h, o7 Z% K  m活動完全免費，更有豐富的獎品等你來拿。歡迎立即報名，活動網址:http://www.cadence.com/tw/events/Pages/Default.aspx。

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Cadence Senior Vice President Dr. Charlie Huang to Present
) _; l7 _( c% g' V" t& w- VAt EDA360-Cadence Tech on Tour – Taiwan 2011 at Ambassador Hotel Hsinchu   

WHO:
黃小立, Cadence 益華電腦資深副總裁

8 e4 u7 M% e. P. }6 Z% d. A% B  mWHAT:
Cadence 益華電腦資深副總裁暨公司策略長黃小立博士將於EDA360-Cadence Tech on Tour – Taiwan 2011 進行專題演講，演講題目為 “Realizing EDA360”。

黃小立博士將與您分享電子系統設計領域所帶來的轉變，以及因應這項轉變的EDA360半導體大趨勢，進而呈現EDA360願景特別針對40/28nm所達成的產品解決方案，協助更多業界精英，在越來越嚴峻的開發環境下，克服設計挑戰，具備更高競爭力與獲利力。

WHEN: EDA360-Cadence Tech on Tour – Taiwan 2011
2011年8月9日; 星期二
09:40am – 10:30am (50 mins)

$ U/ M, {( M2 T* j6 b& T# mWHERE:
9 t2 {5 e$ ~& H新竹國賓大飯店10F (新竹市中華路二段188號)

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EDA360 Cadence Tech on Tour 2011 09 Aug 2011 歡迎參加EDA360 Cadence Tech on Tour 2011，了解電子產業設計大趨勢!!! 詳細內容我要報名

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Event Title Open Verification Methodology (OVM)-System Verilog Workshop 12 Aug 2011 The Open Verification Methodology (OVM) is the first truly open, interoperable, and proven verification methodology. The OVM is an open-source SystemVerilog class library and methodology that defines a framework for reusable verification IP (VIP) and tests. It is 100% IEEE 1800 SystemVerilog and provides building blocks (objects) and a common set of verification-related utilities. The OVM release will be under the Apache 2.0 license, enabling anyone to use OVM libraries for any purpose, including creation of derivative work. 詳細內容我要報名

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CPF 1.0 Workshop (1:30-5:30) 26 Aug 2011 想了解Common Power Format (CPF) 1.1 的功能嗎? 想知道CPF 1.1如何成就眾多設計成功案例嗎? 我們將展現CPF 1.1的設計流程，趕快參加Cadence益華電腦免費的CPF1.1的產品技術體驗營吧。 詳細內容我要報名

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Event Title Low Power Workshop - Frontend Flow 16 Sep 2011 想了解協助每個設計環節功耗管理的設計方法，加速低功耗晶片設計實現嘛? Cadence益華電腦的通用功率格式(CPF)為基礎的參考設計流程能夠助您一臂之力，趕快參加Cadence益華電腦免費的低功耗設計流程hands-on產品推廣體驗營吧。 詳細內容我要報名

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Low Power Flow Workshop - Back-end Flow 23 Sep 2011 想了解協助每個設計環節功耗管理的設計方法，加速低功耗晶片設計實現嘛? Cadence益華電腦的通用功率格式(CPF)為基礎的參考設計流程能夠助您一臂之力，趕快參加Cadence益華電腦免費的低功耗設計流程hands-on產品推廣體驗營吧。 詳細內容我要報名