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大家在這版可以如何互相成就共同邁向Layout達人之路!?

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1#
發表於 2008-4-7 12:53:14 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我是 Hao 前來 chip123 報到
7 K6 Y7 ?1 x6 q2 Q" C8 `5 ^% mhaosaire:想向大家說的話:希望能在這裡變成 Layout 達人) {# R5 d' l8 Y

" u# \! h" @' f% I- Q大家在這版也許可以,或應該如何互相成就共同邁向 Layout 達人?. |7 @+ w7 P* Z% N: d. f
2 z# J, X. G4 l) A( Y
layout中該注意的事情 / M2 j; p4 t* v
結訓於IC Layout課程的學員請自我檢視專業能力   ~) }  }* r- @% ]$ ?
佈局工程師應該成為十項全能冠軍!?   1 2   H+ J# b4 }6 j9 e) P1 L
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[問題求助] :知識討論
( q' b  n! w* U9 X[經驗交流] :知識交流3 l' g- h) d- j, I/ O. q0 \4 E% z; G
好康相報   :知識分享
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. m) r4 Y* U# w: ]底下為三家公司所徵求的Layout 達人:大家有哪些可以討論的呢?   派遣?年資?溝通?管理?
7 x, x' j6 j; x! V+ R9 X. v7 l' E2 Z5 G9 W+ x4 `* O
類比IC設計主管IC Layout 經理IC Layout主管
長期派遣,直接管理人數約未定非管理職,無需負擔管理責任非管理職,無需負擔管理責任
5年以上mix-mode IC design 經驗( r2 @% O) ?" _, D2 r
sensor or image 類比IC設計經驗者
" W2 L( ?" a3 h8 p0 \熟手機及電腦週邊產品應用
需負擔管理責任,Analog layout經驗熟悉Calibre tools1. Analog IC Layout# S' i( n5 X8 f- |& O& S6 C) {  \7 L
2. Command file edit  k  O* @( U' {1 \" R2 Q
3. Project Plan: [# h! {3 m2 M! o  j* X
4. Latch_up預防- C8 G) s5 T( R- Q; b
5.新製程了解
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Calibre & DRACULA
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0 L4 m1 f3 z. @2. 有高壓製程經驗為佳.
' A% E$ I) ]: l3.了解Dracula command file 語法7 b7 f0 r: q% x/ l  y
4.有能力了解新製程
8 Y1 E" w- [2 F4 l, C0 F% J5.具良好溝通能力,具責任感
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% }3 r1 h6 h6 o+ b) h1 g# k
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2#
發表於 2008-4-8 09:41:43 | 只看該作者
大大你所說的IC Layout 經理這項
4 a. M. D% n" @  g- B6 j2 m有打非管理職,無需負擔管理責任
0 L. _4 ]7 O9 \( {* F$ k但是底下又寫說需負擔管理責任???2 o. d& }, i3 I" W
可否說明一下
3#
發表於 2008-4-8 10:16:28 | 只看該作者
的確奇怪!也不知道到底要不要負擔 管理責任?大概可能要吧?!
: P/ y7 V  T& N/ o8 z, i3 I- z. y/ K7 m8 j0 u5 J: E
多數的資深layout達人會希望承擔管理責任麼?還是因為卡位的關係而不得不?不過看來,業界的確很缺layout工程師? # q, ]7 f) G' v  M( F2 q( }, ~
7 T; O7 p! M2 d% x! Y
緯拓科技股份有限公司
# e! T' b6 F; s  c. v# L& P- {- _: k2 a" y  _, J) e9 |
【職務說明】 需負擔管理責任,Analog layout經驗,熟悉Calibre tools。 6 f: t! R( B4 }& G: j" k  \) A
【職務類別】 IC佈局工程師 ( O6 J6 e* t$ e+ ^+ B
【管理責任】 非管理職,無需負擔管理責任
' U6 d! |9 ~0 |. v; S5 j# V9 M8 N8 I. W2 j0 n( D6 s% u6 d
·Manage the Physical Design team in Chengdu! T. {. v- n( c
· Library Development, Layout, and Tapeout for analog and mixed-signal ICs.
# \# r2 I( e% I· Work with O2 world wide engineering and product teams during product development stage.
9 h* d/ N, V+ w- W, i  G7 |  ?$ z( S# @9 R0 t; p
需負擔管理責任,且直接管理人數約4人以下) F1 i) C' Q2 W0 f, u- |5 b
·BSEE (MSEE preferred)
6 v/ G0 L3 d. ]. u( s! j/ ~: [4 X· 5 years experience in Analog IC Design, Physical Design, Physical Verification, and Tapeout& ]7 W9 N0 u' Q! s/ \7 |
· 3 years experience as a Manager and Team Leader
, {% K3 v7 n7 R7 P+ f2 M" u4 ?7 ^- D· Demonstrated ability managing projects with a high degree of organization and prioritization
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· Fluent in English and Chinese
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