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[問題求助] MoM電容在LVS的錯誤

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發表於 2022-7-20 11:16:55 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
本帖最後由 wuhy 於 2022-7-20 11:18 AM 編輯 : v  @0 M+ D+ @0 H

) q( R' _$ |, V: g各位好,小第剛進入Layout工作不久,最近在繪製M1~M4的MoM遇到LVS和schematic對不上的問題
) V+ N8 n& S* X% g! y1 ~5 b使用的製程是SMIC013,使用工具爲Laker/Calibre& e$ |- T. k% h- ~; J: k7 w
LVS錯誤如圖:h ttps://imgur.com/vnbjH5V
, q8 L8 N7 H6 Y; G
  R7 l2 R( C+ T* `netlist如圖:h ttps://imgur.com/IF8qvhC  k8 N7 u- ?# h4 w9 n" q

. v0 e' L9 f- Y& B  L6 g( }layout如圖:ht tps://imgur.com/amp5eSM
" M$ y& q! R7 O8 k& r
$ _; R% I6 D5 w5 i) Z+ [8 w; P5 d. l* \' B) b# Y4 N9 w! n6 l2 B, U
我確定我有加上MoM的layer讓LVS去認9 E9 L7 s; i$ D9 }( }% X
從LVS可以看到他有抓到MoM,且生成了mom14_ckt的子電路
8 e! t4 ~2 J- t) V; Q但問題是LVS生成的layout spice內mom14_ckt是空的(我猜是based on名為empty_subckt.sp的檔案生成layout spice)/ J/ \9 K3 J: w  t
所以LVS才會報錯
* F! V$ d! `! I$ Z% N' f  F/ y; R, u9 m9 Y
我有看到有人在Calibre->Setup->Netlist Export Setup的Include File填入empty_subckt.sp的路徑(h ttps://zhuanlan.zhihu.com/p/87398682)
+ r. Y; G) r- f
6 Y4 i" _. h" A* T9 P

; z# G6 W# y# H但我使用的laker找不到能設定netlist export的地方
$ u% d! B/ h) A. tht tps://imgur.com/jzWvgoV
- O6 u7 Q2 [7 {! c% C8 f0 m' [. v& w6 O
請問各位先進我該如何處理這個問題?
3 m, h9 ~( D5 R5 P; s: |+ u/ l: T0 j  [' q! N2 [; x
6 m9 Y0 e6 ~9 f2 f$ ?( G

! h! W7 Y2 z. T9 M4 K* W
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