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樓主: jauylmz
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在Layout時最花時間的工作是....

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21#
發表於 2007-12-25 09:32:04 | 只看該作者
1.我也認為 floor plan 最麻煩,因為一個好的 floor plan 除了能讓訊號線走的順之外,也可以節省面積, J4 p- Q% Z8 e. Z3 h/ ~* z
2.接下來我覺得比較重要的是 power and ground line 的跑線,因為要走的順才是最重要的,而且若POWER途中一直換線其實也會降低它的電流
" L) s( a4 V2 V: t3.接下來我覺得都還好,因為 DRC LVS block 刻好就會 RUN 了 ,另外create block本來就需要花一點時間
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22#
發表於 2007-12-25 11:52:01 | 只看該作者
如果位置沒有排列好ㄉ話!面積會變大∼甚至拉線會亂七八糟ㄉ∼
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23#
發表於 2008-1-27 11:14:54 | 只看該作者
最花時間的應該是  給你的空間不夠
2 ]3 n4 X, C+ Y6 `. J( h4 {你勉強把東西 塞進去之後  好不容易做完. I; K( ?: T$ q2 G$ Q3 G/ Q7 o0 y" Z
結果電路圖又變了  你就完了
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24#
發表於 2008-2-5 20:17:01 | 只看該作者
以我們公司來說$ _  J4 e3 j$ X/ C/ D: Q
一直改圖對LAYOUT來說是最花時間的- u' y* J- ^7 R' ?$ s3 n! `
或者是 沒有看清楚 RD寫的NOTE  @, _9 ~2 z% C
導致LAYOUT雖然能過LVS 但是LAY法卻是錯誤的& U: D+ Y3 K: r8 |: P  C; _
% I% ?* M: n1 }  N
有時候我們公司RD也不想讓LAYOUT一直改
6 Z$ x5 u% }# ]2 K& t# h+ ~6 Q/ ?只是因為有時專案太趕9 Z3 T+ ^. A; s
所以只好跟LAYOUT同時平行做" I; x: h  g! p% O7 o
這樣就容易電路常常會大翻盤
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25#
發表於 2008-3-19 13:01:26 | 只看該作者
我是選擇排列~~~0 y. |: ^' j& e
光是排列就會影響後續走線( d) f- |) D" ^1 D# C9 Z
所以要特別注意~~~
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26#
發表於 2008-3-25 09:49:52 | 只看該作者
元件的排列、拉線都會有很多要求之類的# s5 U$ c! ]* f/ A
最辛苦的就是改圖~原本己經畫好的,但是rd突然說要改圖
8 p: @% }3 l  F. N然後整個的大小不變,但是改的地方,又比原來的大一些' e' j1 W/ C3 f( b* W& c
這是最麻煩最痛苦的
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27#
發表於 2008-5-26 22:19:14 | 只看該作者
Re-layout往往是floorplan做得不好,所以floorplan是很重要。
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28#
 樓主| 發表於 2008-7-9 18:34:24 | 只看該作者
Chip Integration    可以算是拉線和DRC/LVS 嗎
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29#
發表於 2008-9-9 09:36:20 | 只看該作者
其實上述所有選項都基於兩個字 : "溝通".如果與designer溝通不良,即使畫的像藝術品一樣,花的在久精神部局與除錯,只要designer說不是他要的,一切枉然,全部重來.
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30#
發表於 2008-9-10 14:56:03 | 只看該作者
以上皆非" }* E8 A1 a' X# `0 X( r) {
, L: D7 x9 G; @4 G4 {4 u
我花最多時間的是在思考,
' h/ |1 I1 f! N& _, q* @  U# Z一個5天該完成的案子,我可能會花去2~3天思考! ~' I1 ~/ W0 b5 P' \* w# Q
事前想的仔細,& q; W0 o5 g8 _6 i8 _0 @' ^. ?: J" ]  [  Z
開始動手layout一直到驗證完成都會很快而且順利。
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31#
發表於 2008-10-23 16:34:30 | 只看該作者
都很耗時間!!!  只要 動手 下去做  都是 耗時間!!!  哈哈~~~  用呼叫的 自動拉線  才是王道~~
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32#
發表於 2008-10-27 17:07:49 | 只看該作者
布局和整合最难,最能体现实力!。。。。。。。。。。。。。。。
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33#
發表於 2008-11-9 00:01:28 | 只看該作者
我也認為排列的部分還是會花費較久的時間,可能是因為剛接觸Layout沒多久,經驗不足顯得更無力!: `4 s' M; i4 h6 s
整合這部份,如果是自己獨立一人完成,雖然時間耗費較多,但是就跟寫程式一樣,如何去安排自己的line能走得順
; {+ E6 |, p) V' x0 ?; z: Y我想這才是最重要的!重點一句:還是經驗比較實際吧
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34#
發表於 2008-11-18 11:04:16 | 只看該作者
有不花時間的嗎: w" n5 J' C4 S  A
LAYOUT我覺得每項都很花時間
' x  y' t' N, g1 X不管是佈局還是LVS/DRC; M( t: p3 E+ H- [& u0 Q' J
每項都得小心翼翼* Y# p8 a  O8 b" \% o$ a; a  S& C
做快不見得好
. z' k. `# M/ g* A7 X2 {3 {& w做對才是重要
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35#
發表於 2009-4-9 01:03:28 | 只看該作者
我也覺得 floor plan 最麻煩~0 M7 C9 r4 O5 f. p% N
因要如何將每個block充分擺到適當的位子~
7 Q, m3 j" z& a0 M9 @9 D7 d這是一種學問~6 U2 z4 p4 u# U- M. A' X
因擺的好的話~
  b3 `) g* v* E# d- n0 j. U其他的閃線或拉power一切都還滿ok的
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36#
發表於 2009-4-24 13:19:48 | 只看該作者
2.  排列 Placement   3 T: y: x, H- O% C* ]* ~
6.  整合 Chip Integration& p0 ?+ Y9 [& w
7.  溝通 communication
. c; w* F( k/ b) q7 d1 ]這三個最麻煩
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37#
發表於 2009-6-27 01:02:39 | 只看該作者
排列最花時間吧2 A4 x/ E# @$ S" L3 k1 F
, b: V1 o' l  T
在layout初期就要花很多時間先想好如何排列+ Z1 I* @# ]3 V; M  A; \

/ x2 q3 f/ F# Y+ {: d想好後,反而才會省下大量的時間
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38#
發表於 2009-7-4 12:07:08 | 只看該作者
位置該怎麼擺真的需要一開始的計畫...
& G7 q, [" _3 d, g要不然最後會發生難以挽回的錯誤啊>.<
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39#
發表於 2009-7-8 11:56:51 | 只看該作者
floor  plan比較花時間  只要floor plan 做好   2 g6 I5 W2 H! p

9 F# R( k6 R; m' V3 B$ F其他就會很快   相對LVS 問題也比較好除錯1 l3 ~9 Z" A+ n% Z* Q) p; K" a+ t

* F8 q# s4 F' Z* l4 JHR.概念有  應該DRC LVS比較不會有問題吧
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40#
發表於 2009-9-3 09:08:46 | 只看該作者
我覺得placement和溝通是花最多時間的,因為會決定你的做法和拉線的容易度,
7 Q0 M) b1 D3 y$ m再整合時也會是另一個問題
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