M0 M3 M4 Soft IP Cores For Sale

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├─AT420-DA-03001-r2p0-00rel0
│  └─docs
│          DDI0337G_cortex_m3_r2p0_trm.pdf
( d% M4 u; n- j8 E" N2 [ │         
* L# z" e2 T4 Z6 V/ {- D ├─AT420-DC-02008-r2p0-00rel0
│  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
│         
├─AT420-DC-13001-r2p0-00rel0
4 E! [: P. ^( q3 [ │  └─docs
, g0 w- r8 ~: Z
│  │  │          CM3CodeMux.v
, C9 X+ l! V/ ^! R │  │  │          CM3flashmux.v
│  │  │          CM3ROMTable.v
3 d1 Y; F2 V& v) W$ M. } │  │  │          CortexM3Integration.v
│  │  │         
' k; T; |# Z8 E+ R │  │  ├─dapswjdp
0 P! d( ]7 p7 U7 V7 y) J, }+ C │  │  │  │  README_DAPSWJDP
$ R) Q6 ^6 l3 t( l3 f% F │  │  │  │  
6 N* S8 t/ L# g4 i" _! d3 H) U │  │  │  └─verilog
+ G& L, x  ~; e9 e9 q! s1 Z │  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
, D9 j' G  H& C │  │  │          DAPDpApbSync.v
6 ?: C' G! k1 C* p* D: `; } │  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
7 T8 i1 s! C# @, J, R# c, X+ V │  │  │          DAPDpIMux.v
2 d2 }( w% J) } │  │  │          DAPDpSync.v
8 @, S: g# g' e  l3 q# ^ │  │  │          DAPJtagDpDefs.v
│  │  │          DAPJtagDpProtocol.v
│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
7 ?- [& n+ R2 Z4 _9 _: n │  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
│  │  │          DAPSWJDP.v
/ y8 l3 \( Y% w, v; J3 ] │  │  │          DAPSwjDpDefs.v
5 q/ ^" Z! Z# G+ H9 |% p5 x6 v" k │  │  │          DAPSwjWatcher.v
│  │  │         
│  │  ├─models
│  │  │  └─cells
│  │  │          CM3ClkGate.v
" {1 ~/ a5 |" Z │  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
2 `: D6 ]) l0 k' v& \$ g │  │  │         
│  │  └─tbench
│  │      └─verilog
  d7 f( b* ~7 i& d* y# _1 w; [/ n │  │              AhbToApb.v
│  │              AtbLogger.v
│  │              BusMatrix.v
) i% |6 ^2 F% ]7 E │  │              ClkReset.v
│  │              CM3BusComparator.v

# ?* e" n5 e( G$ p9 E3 j
5 R: _7 E4 I7 o' k0 c$ n │      │  │  exclude_list.sc_waitstate
2 \8 y% T  u- l, c$ t9 c
) i0 L) B: ~' I8 R% Y; c             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
             │      │  
+ I2 D' L" C4 H* `; }8 K' `( i             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
             │              cells_1.geo
             │              cells_1.pwr
6 Q  \- C& f* C3 h$ j             │              index.cli
4 F- Z& Z/ [2 C8 l8 d! _             │              README.TXT
             │              rulesets
- n' Q# ^6 J. X4 U# L# u$ P1 ~% Z             │              VERSION.TXT
             │              vias_1.geo
. P/ E* K! R1 i/ l% U+ q/ \             │              
             └─tsmc
9 S  }4 T% J  i0 i/ b  {# _8 B                 └─t-n90-lo-sp-002-f1_1_6a_20060914
4 K' p" I5 ]+ A- J/ A: x* p                     └─6X2Z
                             corner.defs

' W# o$ ~$ q0 |& u7 x├─integration_kit
│  ├─logical
& O( R3 O2 I+ _4 u- G4 V# F& {8 Z │  │  ├─cm0ikmcu
│  │  │  └─verilog
│  │  └─tbench
│  │      └─verilog
│  └─validation
9 q7 {4 u5 Y: s0 o: N │      ├─glogs
│      ├─logs
│      ├─mdk
│      ├─srpg
! Y8 H" c6 t$ ?6 p( p# }8 i, S, ^ │      ├─tests
1 y' ^# \- G0 Y3 R │      │  └─CMSIS
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% Y' G4 h6 Z# q │      │          ├─CM0
* `. P. k$ ~+ U' J( n- |. v$ a" L │      │          └─Documentation
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├─ipxact
# L9 G/ [# a3 j' c" J │  ├─busdefs
! ?" a2 i% e0 C7 ]; ~7 N$ t │  │  ├─amba.com
1 v. r* f$ F: P8 O" j' A/ o │  │  │  └─AMBA3
( B8 S7 v4 t) a7 H) j( J) G: C │  │  └─arm.com
5 O: ]6 z  k9 k( t( X │  │      ├─CoreSight
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