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├─AT420-DA-03001-r2p0-00rel0
6 r' g5 U8 h1 J" G6 T% A. M" W │  └─docs
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: N0 s+ o1 k9 K6 M │  └─docs
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( [( p6 T  v0 R" O0 f4 P+ N& v │         
4 h2 j! M  W/ ]* V, g; { ├─AT420-DC-13001-r2p0-00rel0
' j' X$ U7 Z* i: D/ }/ G1 w. R0 n+ i │  └─docs

% c" i8 z7 y% e/ ^ │  │  │          CM3CodeMux.v
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+ J* R! h, _8 T7 U+ \2 s │  │  │         
* l: F. X/ K+ l# w5 E1 \' p │  │  ├─dapswjdp
9 J) {7 W& V: [* W- ~6 } │  │  │  │  README_DAPSWJDP
3 z: ^: x% @8 h4 _: ]' I │  │  │  │  
# C# @1 e0 M& P4 c3 h5 N │  │  │  └─verilog
4 K) Z( {9 R1 J& W7 c; t# @ │  │  │          DAPDpApbDefs.v
" T' C" H3 f  C# Z8 D  b4 R+ T4 ?: n" j; q │  │  │          DAPDpApbIfClamp.v
% s! h4 W" c* I! b5 `3 m │  │  │          DAPDpApbSync.v
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( s& j6 T, W  ~# V1 ^ │  │  │          DAPSwDpProtocol.v
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( m* G' {; W* D0 }" E% ] │  │  │         
7 B: o) K, X( y) z- ]5 D" }  U* R │  │  ├─models
│  │  │  └─cells
9 b4 h! ^  D& }/ D9 u' Q │  │  │          CM3ClkGate.v
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│  │  │         
* W$ |) @9 O& l: Z5 O │  │  └─tbench
│  │      └─verilog
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8 h$ _9 W; @, k8 O

│      │  │  exclude_list.sc_waitstate

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- H, x1 r. q! v( e& ]. P2 b+ _             │      │  
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