M0 M3 M4 Soft IP Cores For Sale

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├─AT420-DA-03001-r2p0-00rel0
│  └─docs
" S0 W4 h  e! g( L8 Q0 G* H │          DDI0337G_cortex_m3_r2p0_trm.pdf
│         
; a5 h, {' r" m8 U ├─AT420-DC-02008-r2p0-00rel0
# P$ u: Q' |* d- l. _' _3 J │  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
- _/ f+ C" w. k! s2 X' w$ [3 s- u0 Y │         
: p$ B; L, r: o) s! `" V ├─AT420-DC-13001-r2p0-00rel0
/ Y9 y* d0 K* Z) N+ l3 k0 y- M# d │  └─docs
1 I2 i! ?3 Y  p7 w
│  │  │          CM3CodeMux.v
6 v6 ^8 O, Y. E/ _ │  │  │          CM3flashmux.v
│  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
) x& u8 x9 J3 Z0 }/ ]" i │  │  │         
5 W0 ]' J0 z+ t4 |+ W8 ] │  │  ├─dapswjdp
/ G1 H" C% I' U% C& O │  │  │  │  README_DAPSWJDP
│  │  │  │  
4 b" n$ I+ T' J1 C- \7 [ │  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
│  │  │          DAPDpApbIfClamp.v
│  │  │          DAPDpApbSync.v
! t+ N+ N1 O1 e$ V │  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
3 V# x+ X5 S5 T. U* n& i │  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
│  │  │          DAPJtagDpProtocol.v
7 i8 ~, D. q: _0 F. l │  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
│  │  │          DAPSwDpProtocol.v
3 _! f1 R6 `3 G; `" u │  │  │          DAPSwDpSync.v
, p8 t7 M+ [9 E$ r$ \; o │  │  │          DAPSWJDP.v
│  │  │          DAPSwjDpDefs.v
│  │  │          DAPSwjWatcher.v
# l9 ]! q1 c# Q! p& q/ z2 b) A │  │  │         
│  │  ├─models
│  │  │  └─cells
8 M  f- ?/ m! O( z- v! B │  │  │          CM3ClkGate.v
8 K6 w9 _7 d" p. }1 b7 f │  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
│  │  │         
│  │  └─tbench
5 S6 |& G7 s" r* U; B# K  d+ Y │  │      └─verilog
/ H8 ]" |/ z) g) Z& ] │  │              AhbToApb.v
" e5 B2 l/ Y% H; m/ ~8 h% P │  │              AtbLogger.v
│  │              BusMatrix.v
- ~7 `; @8 r+ ]' }7 w$ [ │  │              ClkReset.v
! [2 f0 s/ Z- _( b5 W! Z3 @3 m │  │              CM3BusComparator.v
8 d0 V+ X6 z% Z' U+ ?3 j
+ q) N# D" A+ j9 k5 K
│      │  │  exclude_list.sc_waitstate
" g) I. X9 p9 i9 E9 D
             │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
3 Y% G+ |. W" C( G3 L( F             │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
+ e1 \" ~. |( P, B$ u% _             │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
             │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
. h: ?7 b- Y) ]1 {# N+ v7 W             │      │  
, g5 C1 R6 E( p1 k2 H) \- r% ]0 }5 Q+ R             │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
. r/ O) @" d1 c% U% I! f             │              cells_1.geo
! }* T% Y/ q( h# q             │              cells_1.pwr
/ ]" s+ t+ W8 J( q             │              index.cli
             │              README.TXT
             │              rulesets
             │              VERSION.TXT
. I/ J" T/ N  `             │              vias_1.geo
             │              
             └─tsmc
                 └─t-n90-lo-sp-002-f1_1_6a_20060914
' L% S! w) g% I' B0 c3 e! ]) {                     └─6X2Z
                             corner.defs
/ w( O  W6 F& G$ W
├─integration_kit
* S, u+ e) U  e0 v │  ├─logical
4 }! [+ w: F4 d0 q5 ?  C  T │  │  ├─cm0ikmcu
│  │  │  └─verilog
+ D. Q: G, q1 c" M6 R │  │  └─tbench
│  │      └─verilog
1 s% P4 n( o9 A" O( U' ^ │  └─validation
│      ├─glogs
  E# C$ a6 P9 o" c$ s │      ├─logs
│      ├─mdk
( h$ p4 ?5 E, W" v │      ├─srpg
│      ├─tests
' N* S; W0 Y+ B7 J( i# F │      │  └─CMSIS
- ~4 E* i8 ^# G1 K9 x9 J3 Q │      │      └─Core
│      │          ├─CM0
4 ^) @+ y8 Q* I! e: y- h │      │          └─Documentation
│      └─vectors
7 M1 n; l8 a8 q2 X4 B6 o4 Z+ m- ? ├─ipxact
│  ├─busdefs
6 x" |' a# @/ ~; b5 v │  │  ├─amba.com
│  │  │  └─AMBA3
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1 m& s, e& G% w2 T │  │      ├─CoreSight
│  │      ├─Cortex-M0
" o1 k* Z* ^/ q- R* W% b' V; d │  │      └─CortexMCores
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7 I2 o1 m' ~4 L0 T. G  l │  │          └─rtl
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