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[問題求助] 製成變換跟mos 大size的關係

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1#
發表於 2007-10-8 17:46:05 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
有一組可以在tsmc.18製成下work的電路- E: B/ S% E. Y' w: M  f
* \0 n/ `0 |# {7 J4 q: N
如果改用tsmc.35來設計時 mos大小可以照倍數調整嗎?!# y* m, c8 ]7 B& k

- X9 C; X( r4 L" _, v' [8 l如果可以 倍率約是多少呢??
) b3 x: U+ |- G1 ^  O5 o& v
5 x5 m; b5 Z& V6 i7 H感情大家!!

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2#
發表於 2007-10-8 19:42:31 | 只看該作者
基本上應該不行直接換
, N! [1 J3 S  D* F. tSPICE Model不同
' c7 R8 H6 U" l  X, X: a參數也不同$ P5 t/ k3 U! L( c! h8 [8 {
應該無法直接比例放大
2 s: L* ^: x' m0 i5 O- d7 m$ l: [4 x# d3 n
可是如果數位電路可能可以
0 W2 _9 }" W; F, k1 ]不過放大Rail Time and Fall Time可能會變差
3#
發表於 2007-10-18 09:35:51 | 只看該作者
其實這一部份!! 要看你的規格需求吧!!
8 U4 Q1 q+ v) d8 x! O; ?$ [5 Z: P同樣的  0.18um 的製程!!  都不一定相同!!
5 s7 s; P. R$ a所以  最好依你自己的規格  重新設計會比較佳!!
4#
發表於 2007-11-29 17:48:56 | 只看該作者
還是重畫吧..雖然是同晶圓廠但製程是差了一萬八千里..看看Design Rule你就知道了..雖然之前聽說有一個可以改廠..改製程的軟體但聽說跑完之後還是有一堆Rule要改.......蠻費時的..要不然..你覺得Design  要 Layout 幹麻...  當然..萬一IC不會動..拿來推卸責任...是另一種功能....!!
5#
發表於 2007-11-29 17:58:43 | 只看該作者

回復 1# 的帖子

早期LAYOUT 用參數制
+ b( N7 E) u# `! s2 R就是想這樣做" X2 t  h6 k2 ]& b8 K9 E' z
後來發現不行9 Y- S: Z4 O) z. E4 g/ u
不是每ㄍ都按相同比例
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