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[問題求助] run lvs時的嚴重大問題~狂急~

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1#
發表於 2008-5-27 18:47:43 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位前輩~
+ b0 e+ x0 e& \0 E  D) R- }# m6 W: A" l+ R: T+ i% R
我的layout到後面再跑lvs時竟突然發現~
) O1 M7 m$ a+ R7 L/ r# T1 k0 M& S6 u4 w  _2 O' Y! e
netlist的mos size改變後,但layout上不變,lvs竟然也會過~; t; ~% f& `0 F7 G9 u/ @5 }
2 M; W/ l1 n! w+ C: X0 ]' O4 {" N( _
這是什問題阿~我有畫一個簡單的inv也一樣相同結果~
/ \' T/ _% P- d  R' |8 e/ F# ~* q
8 P& s" E( c0 P* U+ o是command file要改嗎?還是calibre需要設定什麼?5 v# b, `/ s4 i7 k2 A* I# |

  e- M8 h% I3 ~' P& [我完了~
5 J0 M- U0 `  D. r& h6 b7 ~- n5 p
( k: @2 [) A7 o& F( ^請各位前輩幫忙一下~拜託了~
1 q! }  c; q" }4 \5 ^3 k  V+ w- p' c4 S" u0 }: y" s5 v" l5 {
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2#
發表於 2008-5-27 19:32:26 | 只看該作者
應該是有關尺寸check的部分為開啟功能,只要開啟就好了。
3#
 樓主| 發表於 2008-5-27 20:32:10 | 只看該作者
hi~
8 v4 M3 R2 }, F6 \& S+ u' d3 o/ N/ t+ L+ Z2 R
我看command file裡~沒看到有描述check尺寸的部分~
! A. r9 h) P( F; F$ y( p; T+ S/ x  c6 O7 z) |3 [, O
能請在講詳細一點嗎~大概是如何描述這方面的訊息呢~3 i/ @6 b% p% R' d$ x0 R% Q) i

% H' n7 p7 D6 w, c非常拜託~謝謝~
4#
發表於 2008-5-27 23:43:37 | 只看該作者
就是這個誤差百分比沒設成0(代表誤差0%才會過,一班analog是設成0),還有更簡便的寫法,用變數(看到這篇,又被你偷偷學到了)1 C3 R) Q$ f& p  m
TRACE PROPERTY MN(N) L L 0
; n; N8 I$ v9 ?* W3 v# aTRACE PROPERTY MN(N) W W 0- q/ W0 n8 s  ~: \" a" q/ R
再來講一下LVS好了,LVS過了layout就一定會對嗎?窩不一定,其實陷阱很多,寫LVS的人若沒寫好就會錯,只不過會給人下載的應該是寫的很準, 所以也不用太擔心,只是我覺得在寫ERC這塊到不是很完善,更誇張有些人根本連連RUN完LVS,ERC都不會看窩,LVS對,ERC可不一定對,有的是command file根本沒寫完整,有的是有寫你沒打開ERC(Option),建議一下各位layout,command file前面都會說明定義Option,該開該關先看清楚吧!!,程式不會看沒關係,至少前面說明要看清楚,不要拿來就RUN.(又被你偷學到了)
5#
發表於 2008-5-28 09:15:48 | 只看該作者
TRACE PROPERTY MN(N) L L 1 --------將1改成03 \4 W- l& `( t
TRACE PROPERTY MN(N) W W 1 ------將1改成06 O. y5 G! y. ?$ D9 E
TRACE PROPERTY MP(P) L L 1 --------將1改成0
2 p  j) D) X4 lTRACE PROPERTY MP(P) W W 1-------將1改成0
6#
 樓主| 發表於 2008-5-28 09:31:49 | 只看該作者
嗚~嗚~
' E: H; F* }7 b7 z( j+ n5 f
" y3 p! w) v( r. I: j還是一樣~8 r3 p0 _. n0 v. u2 J4 W

: {1 z& ]& Z# ]$ R我把command file貼上來~請在幫我看看是不是有哪裡漏了阿~
- j" y( V& I7 p
7 q4 A% y' u2 {. {SOURCE PRIMARY   "chip"4 s9 W( w3 v/ e7 Y
SOURCE PATH      "./test_chip.net"* ~! d6 _( d* {4 x
SOURCE SYSTEM    SPICE
% i0 p# V, r- D% T6 b1 n- {& \4 e: f2 K  O( v
LAYOUT PATH      "../chip.db"
* y, [, ]" O  s0 B0 e, V4 LLAYOUT PRIMARY   "chip"0 q! b: O5 l$ q1 ~4 u$ D
LAYOUT SYSTEM    GDSII
& q% m, t3 m  @! _' v0 k6 [; k
' l  j; s4 f1 a# k6 BLVS REPORT   "lvs.rep"
2 d* E8 q; c! F5 q" eLVS ABORT ON SOFTCHK YES
6 L. S' F( F0 Q2 v" zLVS REPORT OPTION S2 d2 h& ]  d8 T

. S% `9 t  n& _% G+ E3 o2 p//LVS SPICE CULL PRIMITIVE SUBCIRCUITS YES
- A; E, M9 h9 f; s0 {( ELVS WRITE LAYOUT NETLIST netlist.spi # q) e+ s  Z* r" t8 A
, ?' \5 _& f# `; [, x
PEX INCLUDE LUMPED L1 N_C R1, ^8 w# k5 Z0 V3 C% x! O5 Q
PEX REPORT LUMPED NONE
9 T  R: I/ l0 b5 `; kPEX NETLIST LUMPED "change_cell.lumped" HSPICE LAYOUT# q# W# |* c% R; Z" [' g0 _

2 o* F. i/ ?2 E9 RPEX INCLUDE DISTRIBUTED L1 N_C R1
% p# x* X4 ?  K, b( i% |PEX REPORT DISTRIBUTED NONE; D, f0 L: g% e
PEX NETLIST DISTRIBUTED "change_cell.dist" HSPICE LAYOUT5 l4 D0 V# i8 N
PEX NETLIST SIMPLE "change_cell.simple" HSPICE SOURCE
& }# t5 }+ {/ N9 l: c
: U2 I2 |! p8 {2 RMASK SVDB DIRECTORY svdb query   
$ H2 ^# ~/ B2 S* W. s0 ~8 [( Q! J* _$ h6 G+ D
EXCLUDE CELL "eo064k8fcl4" "pvpp" "pvss" "pvdd"
0 u6 J: ?* s7 b, U( v SOURCE CASE YES
) r! ~% _9 p- Q* w6 k7 j5 | LAYOUT CASE YES5 N) R! @- @9 f. u3 I
LVS COMPARE CASE YES
* W/ V- P* j8 r* A) [6 W2 y: L LVS GLOBALS ARE PORTS YES
( ~& w! A; a0 |8 s  e LVS SPICE PREFER PINS YES
. G+ Q& f! g) w6 E1 x LVS PROPERTY RESOLUTION  MAXIMUM ALL
& @& Q- `8 N" m/ o5 x' J. ]2 Q- Q1 n3 @. `) s5 t. I; i
ERC KEEP EMPTY       NO
% m2 P$ r0 J5 s5 H+ IERC MAXIMUM RESULTS  10006 O) x7 ~+ l' m+ C
ERC MAXIMUM VERTEX   199+ q" ~8 S4 I  A% o$ H/ U8 M
ERC CHECK TEXT       COMMENTS RFI
" ?/ s4 y( W1 i3 g6 L( o
0 p- Z# |7 H) L5 \1 b5 q- K& nLVS POWER  NAME "VDD" "VCC" "EXVDD"
" Z0 |- q- v" q# h4 u* H0 ^+ T" lLVS GROUND NAME "VSS"  "GND"
3 L) \+ j: g1 j1 ?- I, w$ a7 W2 JVIRTUAL CONNECT COLON YES
: v6 ~! _, ?! p7 W4 h# M
) P8 L5 e7 B+ g% B8 t" j) D$ U
LVS ALL CAPACITOR PINS SWAPPABLE   YES7 [6 L! O( w# c! C  k
LVS IGNORE PORTS                   YES
! U3 I- x) \! T  g4 ?9 tLVS CHECK PORT NAMES                   YES
* P3 Y: Q: r1 Q' s9 n" F' V  {  sLVS ISOLATE SHORTS                 YES( `6 U5 [0 d' l. m2 A, T( t, k7 ?

: o" v; R: P  A% z! F2 s3 kLVS REDUCE SERIES MOS              YES
. c0 |5 t0 h# h" ^' }! KLVS REDUCE PARALLEL MOS            YES$ z* [% j$ J1 y; m
LVS REDUCE SEMI SERIES MOS         NO3 ]5 T$ a' N9 l: q. z+ S! O
LVS REDUCE SPLIT GATES             YES
: j3 B1 p8 @9 |- N; E- J7 VLVS REDUCE PARALLEL BIPOLAR        YES [ EFFECTIVE EV_AREA EV_AREA=SUM(EV_AREA) ]
  _2 H1 J0 C2 B2 t) E: iLVS REDUCE SERIES CAPACITORS       YES
6 z, x2 J0 q5 k. g+ r6 uLVS REDUCE PARALLEL CAPACITORS     YES
" y% ~- \% t% j9 \: vLVS REDUCE SERIES RESISTORS        YES/ z- j7 g# j0 m
LVS REDUCE PARALLEL RESISTORS      YES
* w8 B: t! @$ _3 r. z3 aLVS REDUCE PARALLEL DIODES         YES
+ L, }) }: r* w5 W3 T( `) g% P& j" m+ b+ H
LVS RECOGNIZE GATES                ALL // ALL or SIMPLE4 v! c# c; i" [6 V
LVS ABORT ON SUPPLY ERROR          NO                * t3 N! t9 A% _% }- v" }, j. ?

* \4 B6 o/ w3 ~) W//LVS FILTER D(DN) OPEN             $ \" N: y6 @- d, @  p
//LVS FILTER D(DP) OPEN8 V5 G( k& ?2 ~# d1 \' l

$ t! N+ {: Y3 L: K% W( w1 n1 s& lLVS FILTER UNUSED MOS              YES, F  }; _; ]2 ?" s8 N# R
LVS FILTER UNUSED BIPOLAR          YES  b( O+ v( `2 n* X- f1 P
LVS FILTER UNUSED CAPACITORS       YES3 m1 X$ o0 B9 [) Q; d- g
LVS FILTER UNUSED DIODES           YES, c. D4 s+ M3 k
LVS FILTER UNUSED RESISTORS        YES
0 w& a# }! P* Z/ J& c8 y% HLVS FILTER UNUSED OPTION           AB AC AD AE AF RC RE RG
- f6 S$ T7 h: F" q$ p; ^
) u( o, J5 @7 B3 v1 ]/ C" o( vLVS EXPAND UNBALANCED CELLS        YES
" H. B6 J8 T) ?3 s" ?7 x, i1 L
& ]4 x2 @2 n& R. dPRECISION                          10006 U- M, e7 y9 }; c+ E$ k
RESOLUTION                         13 I1 v5 o/ G1 m! R/ x+ {
& a# A" X9 L  q9 I: a1 m
UNIT LENGTH                        U
7 v" a0 p9 n' h/ ~5 Z. Y) w4 `" K% }UNIT CAPACITANCE                   F //FF- d* W* c# A% F
UNIT RESISTANCE                    OHM8 C( q4 }5 Q5 Z5 A6 ~+ P

: {/ {$ b* E9 N( b$ A) BFLAG NONSIMPLE                     YES0 s- g' P! t1 a% f
FLAG ACUTE                         YES
% R! E, X4 B% m  A) m; O3 w* u  [FLAG OFFGRID                       YES
: \6 e! h6 Q( I) j* qFLAG SKEW                          YES
% p2 k6 K, f. }7 g/ \9 _
: v( w; R# t5 X. q% w8 JDEVICE MN(N)  NTR  NTR(G)  NSDN1(S) NSDN1(D) PWELL_B(B)
- J- M3 d2 Z3 s! k' sTRACE PROPERTY MN(N) W W 0) z  c& f6 |  P( _# n  u( t/ a
TRACE PROPERTY MN(N) L L 08 F6 z8 l7 n! n: w

1 z" x! n, n, o& b( R9 oDEVICE MP(P)  PTR  PTR(G)  PSDN1(S) PSDN1(D) NWELL_A(B)( d$ N2 i* N" F/ M4 D- u. I
TRACE PROPERTY MP(P) W W 0
8 V4 ?) T! N/ eTRACE PROPERTY MP(P) L L 0* D* z$ t# ^2 Q: P( Q" O

. y6 a; A3 k% {# k. E+ c3 y請各位大大在幫我看一下~拜託了~
7#
發表於 2008-5-29 10:42:55 | 只看該作者
我看你的問題應該是netlist file path 沒有update到。' E5 g) z; |0 S
也就是說,你依然是用舊的gds 比對舊的 netlist?
- }$ k/ X# R; H1 ~( h這是我的懷疑啦~~
: l+ [5 s, A# L. r& U: g' Z0 b再仔細檢查一遍你的netlist path & file name。. @1 i0 n  A; w' M
因為看起來lvs.com 沒啥問題。
8#
發表於 2008-5-29 17:35:53 | 只看該作者
作layout一定要養成好習慣,reduce option 不論是mos,cap,res.皆要NO
- {+ q7 g" Q6 A% p# }4 }& TLVS FILTER UNUSED OPTION 不能隨便亂開option,/ J# K* A' l9 v4 K, G
這樣可以避免錯誤
9#
發表於 2008-6-2 03:54:55 | 只看該作者

回復 1# 的帖子

曾經有公司同仁問過同樣的問題) t- Y) K2 t2 M$ N  S( }) N! w
結果是netlist 沒update+ N0 \& f! K) `* {: U2 t4 d, c
刪除舊的netlist 重新產生新的netlist file
( Y8 N" n8 X: C! O並open new netlist file 確實的確認修改過的mos size是否為最新的正確值1 H, K5 U& Y* y. \
並檢查path指向是否正確
' p  b5 c% t& @1 T) z, D2 Q; }合理的懷疑任何小細節
10#
發表於 2008-6-3 14:02:26 | 只看該作者
可能ㄉ幾種情形2 C1 @5 z5 u+ G9 r  S
1.資料沒updata( P5 F' v- `% w% z
2.你ㄉcommand file  是沒比對size ㄉ
8 Z; Y- c3 x" H' |% \3.改變後ㄉ差異在容許範圍內) |4 ~: j  r# P
例如 W  W  3
5 G. f) I2 b5 P+ p3 \) ]. {: J    L  L  3
2 Z( h, D* V6 f6 y+ B5 {" c- \$ \; o0 ]& I
表示誤差在百分之3內是OKㄉ
11#
發表於 2008-6-3 14:20:30 | 只看該作者
你ㄉCommand 有下列這行; f- R) _/ ?( m. L
EXCLUDE CELL "eo064k8fcl4" "pvpp" "pvss" "pvdd"
: ]: _) \8 _- t( n+ S8 f( v1 K" }0 H7 U/ t有可能 你ㄉ改變 在這幾ㄍCELL 中
/ {5 X- ?8 W1 Y; q$ y# f. Z0 @這行ㄉ意思是 這幾ㄍCELL 是不驗ㄉ
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