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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › Layout設計討論區 › 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功 ...
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[問題求助] 求教 regulator 中ESD rule MOS該如何佈局才可以讓其功能達到最大

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1#
發表於 2009-10-20 14:20:24 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
5Chipcoin
如題6 T$ |: s; X7 U* l) m
請教前輩們 在LAYOUT regulator 時 其中有大量ESD MOS的佈局方式 該如何會比較恰當
' \+ E7 M3 [4 n( A1 y! g
7 J, |: t$ m, c# m9 q然後又該注意哪些問題  因為我的w/l  30/0.3  現在再跑 POST- SIM.  發現到每個GATE 端電壓都不相同 ) B- `& ~& t! }

1 P+ I$ d8 B* r, `1 f! d8 a請問有哪位大大知道問題嗎  然後那個MOS 為M 228  感謝

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2#
 樓主| 發表於 2009-10-21 14:10:46 | 只看該作者
就此問題 已有解決的方法了
* `. ^9 E+ R  s  P- j9 K  Q; g& q發現到 應該不是我的LAYOUT問題. h; o8 k4 K0 t3 {6 R
應該是我打Label位置的問題 導致 RD在抽RC值 跑POST-SIM.出現4 p: M$ H% b6 X# j+ c8 W% a4 ?
輸出訊號異常問題  重新標定過LABEL後 以解決此問題了 感謝
% Y, }8 O/ `% d3 s6 R, s
7 K8 @" t: H0 X' H$ L8 Q# r$ i* g( d# T- ?% B
煩請站長將此案幫我做結案  感謝
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3#
發表於 2009-10-26 16:00:36 | 只看該作者
提示: 作者被禁止或刪除 內容自動屏蔽
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4#
發表於 2009-11-20 17:16:29 | 只看該作者
回復 2# clarkhuang 3 i7 Y9 |. v; t
* x1 S  D5 w1 u9 r( v
# ~# J3 |2 o1 ?# }$ l
    下次在多注意一下就好
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5#
發表於 2009-11-20 17:18:09 | 只看該作者
LAYOUT要靠經驗的!!!加油
6 o$ s' `% F  {( B. E: HLAYOUT要靠經驗的!!!加油! Y- v6 \7 \2 E$ V2 |; ~6 E. [, [( K2 {
LAYOUT要靠經驗的!!!加油; P: d/ w; r$ }- A
LAYOUT要靠經驗的!!!加油: c  i6 |2 E  p7 X# H
LAYOUT要靠經驗的!!!加油
% D1 s# i5 U9 Y5 L; D& K2 b4 NLAYOUT要靠經驗的!!!加油
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