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[問題求助] 關於做gate level時要如何產生hcell list?

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1#
發表於 2010-9-19 20:50:17 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
各位前輩~
. u) ?% ?; s4 ]" T$ I2 ^
# }% M1 P. c  [  想請問一下,在畫完layout後,要進行gate level的模擬,要下的指令為:# @& |+ @- _( S( t! p/ O
    calibre -lvs -hier -hcell hcell_list -spice svdb/top_name.sp rule_file | tee lvs.log' R0 y; J3 l' \0 j3 b* `" j; w1 ?. p
    calibre -xrc - pdb -rc -hcell hcell_list rule_file | tee pdb.log
4 r' s9 p7 V1 [# v    calibre -xrc -fmt -rc -hcell hcell_list rule_file | tee fmt.log
/ A) G' o6 L  T% a& c  那其中hcell_list是要如何產生呢? 我看lvs report都是顯示所有mos數目,不像網路上是顯示
9 g. C# z& U/ H& Y& C3 c 等效的cell數目(例如and、nor...),是不是我在執行lvs時要在加別的指令進去呢?
8 v5 M$ H0 ~! x/ O. o0 M- x3 H  
% r3 G# e) p. y  請各位前輩幫小妹指點一下.謝謝!4 K' A9 I* T/ J% B* P
  我學校calibre是2008版本的.
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2#
發表於 2010-9-20 22:10:17 | 只看該作者
创建一个schematic,将所有你用到的门级symble全部调入,然后出一个spice,用skill(tcl,perl也一样)写个脚本将SUBCKT后面的名字抓出来,然后再print2遍(如果你schematic 名字与layout是一样的话,不一样的手动改一下),hcell就出来了,注意的是,hcell前面表示的是schematic的名字,后面才是layout名字.
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