請問關於 soc encounter 的 clock問題

kerberos

我想請問有關於SOC encounter的clock問題。
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$ p. L! K1 t8 p% J2 F+ ~- z0 Z我有一個vhdl架構,以"圖"為例,有三個clock訊號分別是以clkin、timer_clk、seg_clk命名。
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因為clkin之訊號是輸入腳,撰寫io檔時就會定義到clkin之腳位,於是執行Clock>>Clock Tree Browser時只有clkin之訊號。
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. c2 i3 f! J9 o7 \但是內部的clock訊號"timer_clk"與"seg_clk"則是要以何種方式定義才能規劃,
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使其訊號為Clock Tree方式呈現??是分別需撰寫至io檔??還是有其他方式完成?
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希望各位能給點幫助

2 O( _; p# ?- V. MPS:
程式(.VHDL)如附件 用Design Compiler 轉給 encounter
# A  x& w5 b' a; Z圖是timer12disp.vhd的原始架構之一