ARM Cortex-M0/M3 Logical Validation Implementation

sinoicboy

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│  ├─Cortex-M0_TechnicalReferenceManual_Frame
│  │  └─graphics
│  ├─Cortex-M0_UserGuideReferenceMaterial_Frame
│  │  └─graphics
. s" V8 |8 [0 T+ I% r0 i- Q│  └─Cortex-M0_UserGuideReferenceMaterial_XML
% k. f3 [1 V3 L$ W* F. U│      └─graphics
2 u7 n. j" |) N+ ]- P├─implementation
│  └─vectors
" s' x0 B- K* z' F│      ├─CORTEXM0IMP
│      │  ├─crf
# u: _' Y2 s6 n% R2 |  d│      │  ├─srpg
│      │  └─tbench
. _) |4 z$ J4 Q: s& C5 Y│      │      └─logs
: y7 q$ v% h* L2 I1 J│      ├─CORTEXM0INTEGRATIONIMP
9 \2 R4 S0 l& ~2 n  U$ Y( O! o% [│      │  ├─crf
; N' W) P! o! O/ j9 w( L* k, n- a│      │  ├─srpg
( Y: U# Y0 P* C+ B$ o$ m% Y│      │  └─tbench
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│          └─VerilogCrf
* j9 a+ {. W: T  Z, B& T├─integration_kit
) ]8 k4 ^* U. J, f# x% Q! z│  ├─logical
3 m  c/ ^) P; l$ g& ]│  │  ├─cm0ikmcu
│  │  │  └─verilog
- x' _* A, T; v* y/ j│  │  └─tbench
* a/ y( V( B/ |5 S5 U% n9 x│  │      └─verilog
│  └─validation
+ h! J4 D8 k+ s/ G1 B, c│      ├─glogs
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$ Y+ e3 G/ `9 E: b├─ipxact
│  ├─busdefs
- j4 b) b2 ^  W% L0 o# i" s3 |│  │  ├─amba.com
│  │  │  └─AMBA3
│  │  └─arm.com
│  │      ├─CoreSight
# o3 ~: i2 x. ?1 J' B- h# m│  │      ├─Cortex-M0
│  │      └─CortexMCores
% m) f* m4 `2 i# K* l6 t$ {) `7 g2 r│  ├─channels
$ i3 X' `2 r8 M" q│  │  └─arm.com
$ h7 d% y& p' A+ X│  │      └─Cortex-M0
& O# n4 S0 L5 z8 G2 a" P# E│  │          └─rtl
│  └─components
│      └─arm.com
│          └─Cortex-M0
└─logical
- M0 p- t+ M0 V; j' o% C& D    ├─cortexm0
2 ?1 R. `5 v9 a+ q* q3 \  a) J    │  └─verilog
0 z9 O; Y- e; u; e/ V) ]) A9 H    ├─cortexm0_dap
    │  └─verilog
    ├─cortexm0_integration
    │  └─verilog
8 v' V4 L8 U' @; i; g: u8 N    ├─models
4 R6 _6 S; O( z" W    │  ├─cells
    │  ├─cpf
    │  ├─upf
    │  └─wrappers
    └─ualdis
        └─verilog

sinoicboy

├─AT420-DA-03001-r2p0-00rel0
9 S% ]$ L" r! b. A) f0 U0 t# L" V│  └─docs
3 q+ h+ c" R! P, g7 T: }+ J│          DDI0337G_cortex_m3_r2p0_trm.pdf
2 g: K7 r, K2 s- H, P: C3 R│         
1 c  w5 B3 `" I├─AT420-DC-02008-r2p0-00rel0
8 ~$ m, H; }* }" k* l, n8 M& K# P$ _│  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
│         
. |3 i9 U' T- L1 ]8 Z├─AT420-DC-13001-r2p0-00rel0
( Q0 d) O# r: a: e│  └─docs
, u( h+ R5 T. _5 N! i  l. V: r
! J$ G+ W/ M! w/ L" o& N│  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
( s4 ^: Q  A( B* @) W8 R3 W│  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
9 n4 N$ J" M9 o' O│  │  │         
8 q# t6 O/ ^, ?│  │  ├─dapswjdp
│  │  │  │  README_DAPSWJDP
│  │  │  │  
5 m8 I( }( `5 c5 L+ S│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
3 Q8 v7 @; V$ H% i│  │  │          DAPDpApbIfClamp.v
│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
- \' C0 ~$ p7 s6 e│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
% u/ q; q$ z. }│  │  │          DAPJtagDpDefs.v
5 e3 I8 ^  K' X  X; M$ |│  │  │          DAPJtagDpProtocol.v
% k5 A8 _; }- C5 G│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
% @4 S" ~3 A9 p, e" G* N6 J9 Y│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
1 R( W- m, ^9 [+ g/ a! y% m│  │  │          DAPSWJDP.v
' A' g' X) e7 |│  │  │          DAPSwjDpDefs.v
│  │  │          DAPSwjWatcher.v
│  │  │         
│  │  ├─models
5 Z5 {0 Q9 `! R3 S" X5 f0 }│  │  │  └─cells
│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
│  │  │          CM3Sync.v
7 v0 P% ]& I* ?/ @│  │  │         
7 a$ v# I! J% G( i│  │  └─tbench
; c( f/ ^$ A. {7 c' I│  │      └─verilog
│  │              AhbToApb.v
7 e1 N# M; b- K' b1 i) M│  │              AtbLogger.v
│  │              BusMatrix.v
│  │              ClkReset.v
, l, M( ]& a) ^0 C8 v8 `  _2 X│  │              CM3BusComparator.v
│  │              CM3BusGasket.v
) E, [% n* T' L" Y- B3 b. t│  │              CM3TestExAcMnAhb.v
3 V  P6 [! w2 z7 Z- x$ J2 {( E+ K' ^│  │              CM3ValAHBSplit.v
│  │              CM3ValApbTrickBox.v
' V/ i8 s( u0 P9 |9 X0 z│  │              CM3ValBusCompareCtrlReg.v
0 Q" n+ T1 a6 W5 H1 ?8 g! E* Z│  │              CM3ValControl.v
│  │              CM3ValDebugCore.v
0 p3 U+ V: @- r8 B$ w9 J│  │              CM3ValDualPortRAM.v
│  │              CM3ValDualPortWrapper.v
/ A% v* M0 S  b1 u! h│  │              CM3ValETMTrickBox.v
│  │              CM3ValHTMTrickBox.v
│  │              CM3ValIRQGenerator1.v
6 e/ }. j2 i; q) f│  │              CM3ValIRQGenerator2.v
│  │              CM3ValJtagTrickBox.v
4 X- p3 Y& E( f! T│  │              CM3ValMemory.v
/ V' u8 _, A7 G+ J/ H│  │              CM3ValPMU.v
│  │              CM3ValRAM.v
6 Y3 F( A( a/ \* p  x│  │              CM3ValRAMWrapper.v
│  │              CM3ValScratchPad.v
+ u+ s; a+ l9 T7 j% @, g│  │              CM3ValSWCapture.v
: i' C  @: ^" C1 E: L0 k│  │              CM3ValTBDefs.v
│  │              CM3ValTraceOutput.v
, \6 j# q8 q$ X/ N+ U│  │              CM3ValTraceSync.v
* t4 B: _" i) u! D! z/ ]0 h; a
- j5 b3 Q3 q* J; ?! Z│      │  │  exclude_list.sc_waitstate

            │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
9 ?5 f0 I7 C4 Q5 O% S0 q. {6 `            │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
7 q+ H4 W* d( r            │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
/ i5 U' s$ g" D9 Y- s$ Y3 S2 e, S            │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
            │      │  
# C' a. \+ h8 F4 m9 w            │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
1 e9 Q5 a' h- D: q) b            │              cells_1.geo
" X, m4 K8 b* g) c4 ~            │              cells_1.pwr
            │              index.cli
) |- B. A5 ^' r8 }            │              README.TXT
4 G% q8 c  r3 n9 H$ O            │              rulesets
            │              VERSION.TXT
            │              vias_1.geo
/ ?" t! f- F) W, J7 U( ~" a            │              
            └─tsmc
4 [, ^/ w# z* c( [$ P/ \/ C& u                └─t-n90-lo-sp-002-f1_1_6a_20060914
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