ARM Cortex-M0/M3 Logical Validation Implementation

sinoicboy

├─doc
+ t$ V2 \, P$ g( }+ Y│  ├─Cortex-M0_TechnicalReferenceManual_Frame
│  │  └─graphics
│  ├─Cortex-M0_UserGuideReferenceMaterial_Frame
│  │  └─graphics
* P  ?- e) e+ p# u7 `│  └─Cortex-M0_UserGuideReferenceMaterial_XML
9 w  x9 Z3 ]" i3 A, D7 a; M# [│      └─graphics
├─implementation
│  └─vectors
│      ├─CORTEXM0IMP
$ x  L8 @6 P/ P7 X2 D, ~│      │  ├─crf
* y( {3 |' Z; f( O5 j! v1 E$ ^8 v│      │  ├─srpg
, f! }' v' b5 |. @  r│      │  └─tbench
" a! L$ [+ @# T6 R5 V. o│      │      └─logs
│      ├─CORTEXM0INTEGRATIONIMP
│      │  ├─crf
7 t3 t- v) l% L& c│      │  ├─srpg
│      │  └─tbench
│      │      └─logs
2 ^3 b& r* c( _4 {+ ^2 l8 T# _│      └─tools
( r1 y  C- b. V& [│          └─VerilogCrf
8 w' G7 ]: `2 U  Z# v/ y├─integration_kit
│  ├─logical
0 {5 M4 S; Q: J1 Q! K% k! `│  │  ├─cm0ikmcu
4 e+ l: D& U/ w6 P3 f│  │  │  └─verilog
7 }6 v& e; W- A│  │  └─tbench
│  │      └─verilog
│  └─validation
% S/ l6 D7 E8 ^6 |! I8 G│      ├─glogs
, a. Q/ K0 V7 Q! ?+ v│      ├─logs
* j6 C0 X7 s2 Z│      ├─mdk
│      ├─srpg
4 H) p  m( H' E7 x+ V  r│      ├─tests
│      │  └─CMSIS
│      │      └─Core
" q- K) e0 W  |% E│      │          ├─CM0
' i/ T% k8 B! x0 x│      │          └─Documentation
│      └─vectors
├─ipxact
│  ├─busdefs
/ c& c' s, a# ?1 Y" d3 ], ^9 w& z│  │  ├─amba.com
5 J2 W# p2 t$ D) D& }4 g/ z$ @│  │  │  └─AMBA3
$ S6 J' J1 Q$ Q9 d│  │  └─arm.com
│  │      ├─CoreSight
6 g/ V0 @6 M" c( D; {* E0 |│  │      ├─Cortex-M0
4 u8 r) w- E! r# Z; X3 Z# t│  │      └─CortexMCores
│  ├─channels
│  │  └─arm.com
- ^1 o/ C* {9 l) F│  │      └─Cortex-M0
# s/ d/ q, q  n  F: A│  │          └─rtl
# d. E# W6 D8 \5 O8 b$ i6 A│  └─components
│      └─arm.com
) d# a- ^8 r* s│          └─Cortex-M0
└─logical
    ├─cortexm0
    │  └─verilog
$ V2 B, f" I$ C+ @1 x    ├─cortexm0_dap
    │  └─verilog
    ├─cortexm0_integration
    │  └─verilog
' Z  ^- V9 i; o6 B; x6 q5 t    ├─models
6 j" K; b# K) _! i% {    │  ├─cells
3 q/ Y: @& M! v4 V1 ^) g    │  ├─cpf
- j: j7 r- ]) R7 W2 l    │  ├─upf
2 M, u* i. }: o- s9 O    │  └─wrappers
    └─ualdis
        └─verilog

sinoicboy

├─AT420-DA-03001-r2p0-00rel0
│  └─docs
! k5 @) E; E. Q# R. J│          DDI0337G_cortex_m3_r2p0_trm.pdf
│         
├─AT420-DC-02008-r2p0-00rel0
1 q7 O, [$ `1 H5 W│  └─docs
│          DII0194A_cortex_m3_r2p0_csg.pdf
│         
├─AT420-DC-13001-r2p0-00rel0
│  └─docs

& t" l, [( |* R. O│  │  │          CM3CodeMux.v
│  │  │          CM3flashmux.v
5 s- s( ]  m& _; p* D│  │  │          CM3ROMTable.v
│  │  │          CortexM3Integration.v
│  │  │         
│  │  ├─dapswjdp
# e; O- x: d, D- |│  │  │  │  README_DAPSWJDP
+ F4 K/ O& E, R: w$ b│  │  │  │  
│  │  │  └─verilog
│  │  │          DAPDpApbDefs.v
" A# M" `% X! G8 }6 y/ s  U│  │  │          DAPDpApbIfClamp.v
* T, D: A- `: H+ o1 s7 T" Y│  │  │          DAPDpApbSync.v
│  │  │          DAPDpClamp0.v
│  │  │          DAPDpEnSync.v
│  │  │          DAPDpIMux.v
│  │  │          DAPDpSync.v
│  │  │          DAPJtagDpDefs.v
│  │  │          DAPJtagDpProtocol.v
: o3 s; N7 h6 V4 P' H) m│  │  │          DAPSwDpApbIf.v
│  │  │          DAPSwDpDefs.v
) J/ s9 _5 t! i! w. e+ B' z0 I$ P$ c│  │  │          DAPSwDpProtocol.v
│  │  │          DAPSwDpSync.v
5 k2 L. u( K, c│  │  │          DAPSWJDP.v
) u! e+ U- A1 O│  │  │          DAPSwjDpDefs.v
│  │  │          DAPSwjWatcher.v
│  │  │         
# H3 X( U" E- g│  │  ├─models
. J, W+ z, U; i' K9 U/ Z│  │  │  └─cells
│  │  │          CM3ClkGate.v
│  │  │          CM3EtmClkGate.v
; E( A, U: Y# `/ f. `6 i. h% u4 c! H: E│  │  │          CM3Sync.v
6 e; c/ u+ u+ x7 r$ N& X+ s! l3 d│  │  │         
│  │  └─tbench
& L8 c3 n3 f# e$ h6 R7 h* B/ q│  │      └─verilog
" ]: R& A& n/ v7 a+ @│  │              AhbToApb.v
( G9 @! X0 R! g│  │              AtbLogger.v
│  │              BusMatrix.v
* C8 U2 |" `7 V│  │              ClkReset.v
│  │              CM3BusComparator.v
│  │              CM3BusGasket.v
7 P+ A, V8 ]8 B8 r+ m6 T( e│  │              CM3TestExAcMnAhb.v
( y/ q. Q. z! F. J│  │              CM3ValAHBSplit.v
  {8 h' Y. l1 _│  │              CM3ValApbTrickBox.v
; R5 t$ z& j2 J+ H  K- ]│  │              CM3ValBusCompareCtrlReg.v
- }: O  a# P1 e/ v) f* x│  │              CM3ValControl.v
4 P7 k# t! X7 t1 J# j$ |│  │              CM3ValDebugCore.v
│  │              CM3ValDualPortRAM.v
- Z' `! J5 i" Y& \│  │              CM3ValDualPortWrapper.v
│  │              CM3ValETMTrickBox.v
│  │              CM3ValHTMTrickBox.v
│  │              CM3ValIRQGenerator1.v
│  │              CM3ValIRQGenerator2.v
│  │              CM3ValJtagTrickBox.v
/ C) u1 F5 Z# ^% ]! M- D8 p8 n$ D( M│  │              CM3ValMemory.v
│  │              CM3ValPMU.v
, t( A: z9 H6 X│  │              CM3ValRAM.v
; e- z6 {7 e: Q4 T; Q0 U5 g│  │              CM3ValRAMWrapper.v
6 Y: _2 b& {- P│  │              CM3ValScratchPad.v
│  │              CM3ValSWCapture.v
│  │              CM3ValTBDefs.v
( h, s3 M+ P- k7 B│  │              CM3ValTraceOutput.v
5 W' y+ T! v5 `% c3 E1 ]│  │              CM3ValTraceSync.v

8 A( B- q# [' R* _  X& z│      │  │  exclude_list.sc_waitstate
$ X8 ]' i4 K2 U5 W
; {9 h6 J. g: w5 T; Z  K            │  └─fe_tsmc090g_sc-adv_v10_2007q4v2
, C/ d# C8 u  b$ d" L  b% m$ Y            │      │  scadv_tsmc_cln90g_rvt_ff_1p1v_m40c.cdB
            │      │  scadv_tsmc_cln90g_rvt_ss_0p9v_125c.cdB
+ N( {9 ]' K: ]6 t0 W* D5 T            │      │  scadv_tsmc_cln90g_rvt_tt_1p0v_25c.cdB
) f& b- @9 t* l- X" x0 F  J            │      │  
            │      └─scadv_tsmc_cln90g_rvt_tt_1p0v_25c_dv.cl
            │              cells_1.geo
            │              cells_1.pwr
( {3 w1 i- @% z9 r0 T) I7 U* i            │              index.cli
) y4 ]& }: d6 j2 M- }, W  l7 R: I            │              README.TXT
            │              rulesets
) [# B3 G+ _5 ^# r! j            │              VERSION.TXT
3 I" t8 ^- x1 G            │              vias_1.geo
            │              
' s% b8 ~) A' O6 u$ {            └─tsmc
4 g& N+ n% K- \2 W) \2 @                └─t-n90-lo-sp-002-f1_1_6a_20060914
0 D) G' K. L" {& V+ h" {# B                    └─6X2Z
& \  ]4 O( J( n- g  z                            corner.defs

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