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[問題求助] 請教VHDL

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1#
發表於 2008-2-1 06:51:17 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
當我宣告如下:, I. C3 U8 }2 c2 Z& v
A : in :std_logic_vector( 7 downto 0);
4 J; w( z- e; K8 t7 D" A1 J) E( T請問為何只有需要一隻腳就可以代表8 bits,可是我們實際用的IC都是8條資料線,我有點混淆,能否請教大家,指點一下,感激!
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2#
發表於 2008-2-1 08:59:17 | 只看該作者
這應該最基本的訊號宣告格式, 其實它宣告出來是個array, * p/ ?+ w# j6 W4 @0 c; @! h
( 7 downto 0); 共 8 個 bits
3#
發表於 2008-2-4 08:56:08 | 只看該作者

那是8條線,

那是8條線的 bus. 只是用了一個名字.
4#
發表於 2008-2-4 09:39:19 | 只看該作者

回復 1# 的帖子

那是Array或Vector的宣告方式吧
4 e* H# G% [3 v+ o9 Z3 F像Verilog 你也可以寫成
9 f% G! z# {9 c6 k, k$ t, `8 ]Input   [0:7]  In;
2 R: g' I: F7 Q的道理是一樣的
5#
 樓主| 發表於 2008-2-5 16:13:57 | 只看該作者

請教VHDL

原來如此,感謝各方的意見與指教,另外小弟再請教個問題1 |2 O: Q8 M7 Z9 [, x/ q
- u" J, u- u( F1 O" p1 ^
http://www.xilinx.com/products/boards/s3_sk_promo.htm
* g  _/ c* P4 j  l5 G- A) ?8 K/ ~2 _. y* @' ^: h
這個網頁上的tool kit哪種比較適合買來自己用?7 p( S3 M7 f; g# e& u

* L% Z* x& d- `2 K0 ]: o5 f, w/ WSparten 3 跟 Sparten 3E的差異有哪位知道的呢?
& s" ^, E* F  J/ x0 ?: ~% O6 S3 @9 D) Q4 N) l4 r
我想買一個適合自己練功且又便宜的ASIC tool kit,希望日後也可以支援個人所設計的DSP處理器的燒錄
4 i9 `- v; V% S2 B# ?0 |4 ~' u2 Q7 v, e, F
懇請大家給我點意見,xilinx的產品線好多,讓我實在是有點眼花撩亂呀...
6#
發表於 2008-10-24 09:36:40 | 只看該作者
"A" is the name of bus, it is not line
7#
發表於 2009-6-8 17:30:47 | 只看該作者
其實我認為用哪一種工具都差不多
8 v, B8 ?) @1 s# a6 S最重要的是看你的需求% {: W7 p4 K& v; E' \3 a5 U8 R+ m; C8 s
若你的需求是純練功
% @7 t$ _* f# f1 V個人認為用到xilinx太高檔的....
8 E. z, z+ Z; L" g0 }8 r% S你可以考慮用altera的會比較便宜
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