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[問題求助] �定周期,可变的DUTY,如何实现?

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1#
發表於 2008-4-28 22:38:35 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
附图是一个OSC电路,可知T=C*(VH-VL)/I1+C*(VH-VL)/I2;+ x5 c* ^% J) k" H4 h# N7 F

, j5 S' m' k8 w可以通过调整C,VH/VL,I调整频率,如果要获得�定周期,可变的DUTY,如何实现呢?3 k" D' t0 Y" B9 w

! N7 P# b$ }3 Y' E" u" d请各位大大指教,谢谢!, J& X4 ^! W3 v. c& N

9 y) `  ?$ a& w( G0 q, P

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2#
 樓主| 發表於 2008-5-3 11:04:31 | 只看該作者
各位大大,有没有好的方法,请指教,谢谢!
3#
發表於 2008-5-5 23:16:44 | 只看該作者
我以前有試過一種在vco後面加duty cycle correction電路,那是為了校正vco的duty cycle而衍化出來的電路  t! ?8 G2 R4 o
那是一種利用負回授的方式來實現的電路2 m' {9 H6 V3 B2 z0 D6 `' `% E
不過,這種電路可能不太適合你的需求% y4 V0 L, V. e1 f/ A
8 O; L' {; H6 D. e) X. X4 Y
而因為你需要固定週期內去變duty cycle的話
* D/ [% h6 t: y% k: w; R那惟有在sr-latch後面再加一些數位電路應可達到改變duty cycle的功能7 s' Y% M6 X& ~8 O# K# q9 l
基本上我想到的方式是利用delay cell再加一些數位邏輯電路應可實現) `3 U6 l, A6 a4 Q
若想加長duty cycle,那就用OR Gate + delay cell電路(加長)應可達到需求
' k) R5 i- F& i. {3 C- M若想縮短duty cycle,那就用AND Gate + delay cell電路(縮短)應可達到需求
1 g0 j) N+ X& h* l$ d' P( ?如此一來,便可利用數位控制的方式,藉由控制delay cell timing即可作出想要的duty cycle
4#
發表於 2008-5-6 15:09:02 | 只看該作者
題外話 2 J! m- T" e+ }, e  ?
VCO duty cycle corrector 是很好玩的電路 1 o& r( @+ r3 b( f9 D# y
我之前有發明一個 拼湊一些paper的概念所組成的電路 也是用負回授的方法來產生50/50的clock
/ N1 l* i4 Z+ R7 |6 A- p+ i% Jfinster大能分享一下如何實現的嗎 也許我可以觀摩一下; ?. H1 W1 V: `7 e  j+ I
我另外再開個討論版好了
5#
發表於 2008-5-6 18:17:37 | 只看該作者

回復 1# 的帖子

也許可拿你電路產生的定頻clock去充放電另外一個可變的CAP或充放電固定的CAP9 h3 a; g( i0 j' U" S
,改變比較器的轉態電壓~~~試試吧
6#
發表於 2008-5-7 15:53:27 | 只看該作者
這是我想到的方法- a2 e0 c) V; A' V% s
利用delay cell和簡單的數位電路應該就可以改變duty cycle
9 J, u% r7 ^% M" X7 o4 t# \因為提問者的前提是clock不能被改變,所以,就只能從輸出的clock著手動手腳,如果改變本身charge/discharge current,或者Vh/Vl電壓,或者電容C值均會改變原來的振盪頻率8 U2 j& K; T7 H7 x! R$ b
不過,這種方法有些缺點,因為delay cell的精準度很難控制,所以,未必能夠很精準的控制duty cycle,當然,如果要很精準的控制delay time,相對的電路就要設計的複雜些
. V- G& z% L# u, O6 u" H3 L再者,如果clock愈慢,表示其delay cell的delay time要設計的愈寛,那用反相器加電容的delay cell未必適合

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7#
發表於 2008-5-8 11:29:18 | 只看該作者
用定頻的clock去控制充+放電時間,所產生出來的clock應該是同樣頻率,2 r! Y) y' r6 }! _( Z
改變電容值或轉態電壓,便可以控制duty,用delay cell做,很難cover較寬1 B3 M% v0 P. ^/ q
的頻率,並非上策
8#
 樓主| 發表於 2008-5-8 21:13:11 | 只看該作者
finster大大是利用BBM(break before make)的方法去做的,谢谢!
+ \1 X1 ^2 o! U: t. T
/ B8 \0 E0 A" ]$ i1 Z. P1 C+ C如果DUTY不连续变化,那么调整CAP可以改变DUTY(固定周期)
# u- u. s3 o8 @T=C1*(VH-VL)/I+C2*(VH-VL)/I,,充放电用不同的电容大小,只要保证C1+C2不变,就可以保证频率不变了(理论上的),
2 I4 g, X* \& W, j1 ]- e+ |# [8 M2 J0 BDUTY连续的变化,上述方法就不好实现了................+ f  i+ A* P9 h- a7 W. s
- U) H3 F* Z2 E7 J' B9 e) r6 D
mbission大大能再具体的讲一下吗 多谢!
9#
發表於 2008-5-9 09:36:05 | 只看該作者
用你上面的電路產生出來的定頻的clock,去控制另外一組RC充放電電路/ r) z" ]2 O. R3 F: T; B
,改變充放電電流比例或切換轉態電壓,應該可以得到你要的波形~~~
10#
發表於 2008-5-10 23:07:10 | 只看該作者
其實上面這個OSC RC 充放電線路,就是555 timer IC的線路主要設計,只不過少了voltage control input(可用來調duty cycle)
  R6 M! I+ S! m稍微改了一下,看可不可以.(VR 用來調duty cycle)
7 _5 L3 A; x# w  E" {; t0 V: O) @: ~, r3 `# l

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11#
 樓主| 發表於 2008-5-11 16:03:27 | 只看該作者
谢谢kevin!
" B+ N0 u; n$ R' r5 k. V# v
8 W! k0 \2 f6 x4 m5 {但是如果VR变化了,那么频率也会一起变化的
12#
發表於 2008-5-12 10:16:18 | 只看該作者
我是假設R4 跟VR很大,所流過的current很小,則VH-VL會保持不變(只跟R2有關),則頻率應可固定.
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