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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › 模块的P&R问题求教
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[問題求助] 模块的P&R问题求教

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eel
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1#
發表於 2008-5-16 09:55:05 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
我想问一下,在P&R的时候,能不能不加IO PIN,
- |8 x$ s/ ~7 U$ h( ]1 m$ j3 L9 z9 h; j; ]9 B( ?3 g: {, `6 V; I
因为我想做模块的版图,不是整个芯片,所以不用外部的IP PAD,  在Astro中可以不加IO吗?( e7 G. l6 ?6 K7 \' R; p

2 M6 m+ }4 U) o- w; p  M  U" R具体怎么操作, 有谁知道吗?
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2#
發表於 2008-5-18 01:10:36 | 只看該作者
在astro當然可以不用加IO pad7 k: J" H0 X! t9 `3 @
我在module p&r simulation或hard core時都這麼做
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