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Chip123 科技應用創新平台»論壇 › Chip1 -- 基礎元件 › FPGA/CPLD/ASIC討論區 › Verilog新手，請問版上高人
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[問題求助] Verilog新手，請問版上高人

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day766
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1#
發表於 2007-7-17 18:31:00 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
請問用Verilog設計一個元件，如ALU, MUL.....3 m& B: S$ K5 a! K0 @( E
4 d! H2 X6 ?) P& w' t* E
跟設計一個DSP (processor) 的差異是在哪些地方呢？
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2#
發表於 2007-7-21 03:39:53 | 只看該作者
我想最大的差異就是...
0 G& E$ V6 |4 h' @alu只需幾10行
' R+ t8 X, Q  p( {/ x' T% M( S' kdsp幾千行也不見得寫的完...

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day766 + 5 Good answer! 哈哈！很抱歉！我的問題 ...

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3#
發表於 2007-7-29 19:26:34 | 只看該作者
你太客氣了, 這是比較基準的問題; h; N6 I% E2 c8 O$ ?) Z2 w; u+ K
你的問題我想應該是 "設計一個ALU跟設計一個DSP的MAC" 的差異才對
$ k0 z8 w) l3 L, l8 w1 `5 \4 |. ?% j3 {( _
不知道是不是?
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